微机原理与接口技术第7章.ppt
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1、第7章 输入/输出系统,PC系列微机系统采用开放式的多总线结构,地址总线经地址锁存、缓冲器(三态输出),数据总线经总线收发器,控制总线经总线控制逻辑之后形成的总线,称为系统总线。(连接主存储器和一般的I/O接口),I/O接口电路有一部分在主板上,另一部分通过总线插槽扩充。,7.1 32位微处理器的外部引脚(教材P.27),1.数据线及控制信号 数据线:D63D0共64位 奇偶校验信号:DP7DP0,每个字 节产生1个校验位 读校验错:PCHK,Pentium 处理器的外部引脚,2.地址线及控制信号,七 一,A31A3:高29位地址线,Pentium 处理器的外部引脚,3.系统控制信号,1.时钟
2、输入CLK2.可屏蔽中断请求 INTR3.非屏蔽中断请求 NMI4.系统复位信号 RESET系统复位后,程序运行的地址为:FFFFFFF0H实模式 CS:F000H,IP:0FFF0H,Pentium 处理器的外部引脚,系统时钟,是微处理器内部与外部操作的同步时基信号,由时钟(CLK)输入信号来提供。,CLK,时钟周期:T状态:就是指时钟周期,T,Pentium 处理器的外部引脚,Pentium 处理器的外部引脚,4.总线周期定义信号(输出)“周期”是一段时间CPU通过总线与存储器、I/O交换一个数据所需要的时间称为总线周期,8086总线周期,Pentium 处理器的外部引脚,总线周期定义的操
3、作,M/IO D/C W/R 操作 0 0 0 中断 0 0 1 中止/专用周期 0 1 0 I/O读 0 1 1 I/O写 1 0 0 微代码读 1 0 1 保留 1 1 0 存储器读 1 1 1 存储器写,Pentium 处理器的外部引脚,Pentium 处理器的外部引脚,LOCK:总线锁定信号LOCK=0,通知外围电路,不允许外部信号打断当前的总线周期。当一条指令有.LOCK前缀时,该引脚输出为0。,Pentium 处理器的外部引脚,以下为X86的基本总线周期时序图(以pentium为例),Pentium 处理器的外部引脚,CLK,ADS,BE0BE3,A2A31,M/IO、D/C,W/
4、R,RDY,D0D31,有等待状态总线周期,T1,T2,TW,T1,T2,TW,T1,Pentium 处理器的外部引脚,6.总线仲裁信号(1)HOLD:总线保持请求(输入)(2)HLDA:总线保持响应(输出),Pentium 处理器的外部引脚,7.2 总线与总线标准,1.总线分类按所传输信号的性质分为:地址总线、数据总线、控制总线,计算机系统按系统层次分有许多模块,这些模块位于系统的不同层次上,整个系统按模块化构建。按总线连接的对象和所处系统的层次来分:芯片级总线、系统总线、局部总线 和 外部总线,总 线 分 类,CPU与连接到系统板上的外设打交道须经过芯片级总线、局部总线、(系统总线)和外部
5、总线这样三到四级总线。,芯片级总线:用于模块内芯片级的互连,是该芯片与外围支撑芯片的连接总线。如连接CPU及其周边的协处理器、总线控制器、总线收发器等的总线称为CPU总线,连接存储器及其支撑芯片的总线成为存储器总线。,总 线 分 类,系统总线:连接计算机内部各个模块的一条主干线,是连接芯片级总线、局部总线和外部总线的纽带。系统总线又称底版总线、主板总线、扩展总线,它把微机系统各插件板与主板连在一起。系统总线符合某一总线标准,具有通用性,是计算机系统模块化的基础。由于经过缓冲器驱动,负载能力较强,总 线 分 类,局部总线:系统总线连接局部总线、外部总线和外部设备 与所连接的CPU和外部设备相比,
6、系统总线发展滞后、速度缓慢、带宽较窄,成为数据传输瓶颈。为了打破这一瓶颈,将一些高速外设从系统总线上卸下,通过控制和驱动电路直接挂到CPU局部总线上,使高速外设能按CPU速度运行。这种直接连接CPU和高速外围设备的传输通道就是局部总线。局部总线一端与CPU连接,另一端与高速外设和系统总线连接,好象在系统总线和CPU总线之间又插入一级,外部总线:又称设备总线,是连接计算机与外部设备的总线。外部总线经总线控制器挂接到系统总线上。,总 线 分 类,总线插槽是主板和 I/O 接口之间的连接 器,为了连接众 多类型的接口电路,主 板一般都配有几 种类型的总线。,PC系列机主板上的总线标准有:XT总线、A
7、T(ISA)总线、EISA总线、VESA总线和PCI总线。,总 线 分 类,2.ISA(AT)总线(P.171),ISA总线是16位总线,始于286机型。之 后在386 奔腾 机上都有ISA总线。(实际上由8位发展到16位,甚至32位(EISA,后 来消失替代于VESA、PCI),当今的主板上都留 有插槽)ISA总线由62芯+36芯两个插槽组成,Industry standard architecture 工业标准结构,2.ISA(AT)总线(P.171),主要特性:数据传输率最高为8MB/S 24根地址线,可寻址16MB存储空间 64KB个可寻址的I/O端口(16根地址线)一次可进行16位或
8、8位数据存取 15级中断控制 7个DMA通道 可产生I/O等待状态 支持多个主控器(XT总线中只有CPU是唯一的主 控设备,而ISA总线可使CPU释放总线由其它主控、器(如DMAC、DRAM刷新控制器等)占用总线),ISA(AT)总 线,GND,RESET DRV,B1,B2,B3,B4,B5,B6,B7,B8,B9,B10,B11,B12,B13,B14,B15,B16,B17,B18,B19,B20,B21,B22,B23,B24,B25,B26,B27,B28,B29,B30,B31,A1,A2,A3,A4,A5,A6,A7,A8,A9,A10,A11,A12,A13,A14,A15,A
9、16,A17,A18,A20,A19,A22,A21,A23,A24,A25,A26,A27,A28,A29,A30,A31,D1,D2,D3,D4,D5,D6,D7,D8,D9,D10,D11,D12,D13,D14,D15,D16,D17,D18,C1,C2,C3,C4,C5,C6,C7,C8,C9,C10,C11,C12,C13,C14,C15,C16,C17,C18,+5V,IRQ9,-5V,DRQ2,-12V,0WS,+12V,GND,SMEMW,AT总线插槽引脚分配,SMEMR,IOW,IOR,DACK3,DRQ3,DRQ1,DACK1,REFRESH,CLK,IRQ7,IRQ5,
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