可编程芯片8255A及其应用.ppt
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1、第9章 可编程外围接口芯片8255A及其应用,9.1 并行接口芯片概述9.2 8255A的工作原理9.3 8255A的基本应用,9.1 并行接口芯片概述,计算机与外部的信息交换称为通信,基本的通信方式有两种,一种是并行通信,另一种是串行通信。,并行通信时,数据各位同时传送;例如CPU通过8255A与外设交换数据时,就采用并行通信方式。这种方式传送数据的速度快,但使用的通信线多;如果要并行传送8位数据,需要用8根数据线,另外还要加上一些控制信号线;随着传输距离的增加,通信线成本的增加将成为突出的问题,而且传输的可靠性随着距离的增加而下降;并行通信适用于近距离传送数据的场合。,并行通信的特点,在远
2、距离通信时,一般都采用串行通信方式,它具有需要的通信线少和传送距离远等优点;串行通信时,要传送的数据或信息必须按一定的格式编码,然后在单根线上,按一位接一位的先后顺序进行传送,发送完一个字符后,再发送第二个;接收数据时,每次从单根线上一位接一位的接收信息,再把它们拼凑成一个字符,送给CPU作进一步处理;当微机与远程终端或远距离的中央处理机交换数据时,都采用串行通信方式。采用串行通信的另一个出发点是,有些外设,如调制解调器(MODEM)、鼠标器等,本身需要用串行方式通信。,串行通信的特点,并行接口技术,CPU芯片本身总是以并行方式接收和发送数据,因此并行接口是微机系统中最常用的接口之一。实现并行
3、输入/输出的接口就是并行接口。,并行接口连接CPU与并行外设,实现两者间的并行通信,在信息传送过程中,起到输出锁存或输入缓冲的作用。,并行接口的典型硬件结构包括:1、一个或一个以上具有锁存或缓冲的数据端口;2、与CPU进行数据交换所必须的控制和状态信号;3、与外设进行数据交换所必须的控制和状态信号;4、端口译码电路;5、控制电路;,简单的并行接口技术,外设将数据=接口 状态线“数据输入准备好”=1;接口把接收到数据输入缓冲寄存器;数据输入回答=1,作为对外设响应信号;外设撤消“数据”和“数据输入准备好”信号;CPU从接口读取数据接口收到数据,设置“输入准备好”状态位;供给CPU查询 或问CPU
4、发中断请求;CPU从接口读取数据,接口自动清除状态寄存器输入准备好状态位(准备好);数据总线处于高阻状态。开始下一个输入过程,输入过程,输出:每当外设从接口取走一个数据以后,CPU往接口中输出数据接口中状态寄存器发中断请求;(“输出准备好”=1,表示CPU可以往接口中输出数据)CPU向接口输出数据,数据到接口缓冲寄存器;接口自动清除“输出准备”好。将数据送往外设:接口向外设发送一个“驱动信号”,启动外设接收数据。外设收到数据向接口发一个“数据输出回答”信号;接口收到的信号将状态寄存器中“输出准好”=1;CPU输出下一个数据。,输出过程,并行接口芯片将数据的各位同时在多根并行传输线上进行传输,适
5、于短距离、高速通信,串行接口芯片将数据的各位按时间顺序依次在一根传输线上传输,适于长距离、中低速通信,0 1 1 0 1 0 1 0,8255A是Intel公司生产的一种可编程并行输入/输出接口芯片;它的通用性强,可以方便地和微机连接,用来扩展输入/输出口;8255A有3个8位并行端口,根据不同的初始化编程,可以分别定义为输入或输出方式,以完成CPU与外设的数据传送。,9.2 8255A的工作原理,图 8255A引脚,8255A采用40脚双列直插式封装。,9.2.1 8255A的结构和引脚功能,D0D7:双向三态数据总线。,RESET:复位信号,输入。当RESET端得到高电平后,8255A复位
6、。复位状态是控制寄存器被清零,所有端口(A、B、C口)被置为输入方式。,:片选信号,输入。当 为低电平时,该芯片被选中。,:读信号,输入。当 为低电平时,允许CPU从8255A读取数据或状态信息。,:写信号,输入。当 为低电平时,允许CPU将控制字或数据写入8255A。A1、A0:端口选择信号,输入。8255A中有端口A、B、C,还有一个控制寄存器,共4个端口,根据从A1、A0输入的地址信号来寻址,如下表 所示。A1、A0与信号一起,用来确定8255A的操作状态,如表所示。,PA0PA7:A口数据线,双向。PB0PB7:B口数据线,双向。PC0PC7:C口数据线,双向。,当8255A工作于方式
7、0时,PC0PC7分成两组并行I/O 数据线,每组4位。当8255A工作于方式1或方式2时,PC0PC7为A口、B口提供联络和中断信号,这时每根线的功能有新的定义。,与外设连接的引脚PA7PA0、PB7PB0和PC7PC0与CPU连接的引脚数据引脚:D7D0 复位输入:RESET片选信号:CS端口选择的地址信号:A1和A0读信号:RD写信号:WR,8255A由并行I/O端口、控制电路、数据总线缓冲器和读/写控制逻辑等几个部分组成。,8255A的内部结构,A、B、C口都是8位的,可以选择作为输入或输出,但在结构和功能上有所不同;A口含有一个8位数据输出锁存/缓冲器和一个8位数据输入锁存器;B口含
8、有一个8位数据输出锁存/缓冲器和一个8位的数据输入缓冲器(不锁存);C口含有一个8位数据输出锁存/缓冲器和一个8位数据输入缓冲器(不锁存);当数据传送不需要联络信号时,这三个端口都可以用作输入或输出口。当A口、B口工作在需要联络信号输入、输出方式时,C口可以分别为A口和B口提供状态和控制信息。,(1)并行I/O端口A、B、C。,(2)A组和B组控制电路。8255A的三个端口在使用时分为A、B组;A组包括A口8位和C口的高4位,B组包括B口8位和C口的低4位;两组的控制电路中有控制寄存器,根据写入的控制字决定两组的工作方式,也可以对C口的每一位置“1”或清“0”。,(3)数据总线缓冲器。数据总线
9、缓冲器是三态双向8位缓冲器,是8255A与CPU数据总线的接口。数据的输入/输出、控制字和状态信息的传送,都是通过这个缓冲器进行的。由于8255A的数据总线是三态的,所以D0D7可以直接与CPU的数据总线相连。,(4)读/写控制逻辑。8255A的读/写控制逻辑的作用是从CPU的地址和控制总线上接收有关信号,转变成各种控制命令送到数据缓冲器以及A组、B组控制电路,从而管理三个端口、控制寄存器和数据总线之间的传送操作。,8255A 的内部结构,外设,1外设接口:包括A、B、C三个数据端口(通道)。其中A口带输出锁存/缓冲和输入锁存,B口带输出锁存/缓冲和输入缓冲,C口带输出缓冲和输入缓冲。,2内部
10、逻辑:包括A组控制电路(控制A口和C口上半部)和B组控制电路(控制B口和C口下半部),由CPU程控。,3CPU接口:包括三态双向数据总线缓冲器和读/写控制逻辑。,对CPU来说,8255A内部包括4个端口,即3个数据端口A口、B口、C口,和1个控制端口。,每个端口8位,通过编程设定其为输入口或输出口 可用来和外设传送信息,1.数据端口A、B、C,有 3 种工作方式(方式 0、方式 1、方式 2)对外 8 根引脚 PA7 PA0,端口A,有 2 种工作方式:方式 0、方式 1对外 8 根引脚 PB7 PB0,端口B,当端口 A 在方式 1 或方式 2、端口 B 在方式 1 时,端口 C 的某些位用
11、于传送联络信号,如查询传送的应答信号、中断传送的中断申请信号等;C口未被用作联络信号的其它位可工作在方式0。,端口C,8位端口,无对外引脚控制端口的内容决定A、B、C口的工作状态(输入或输出)和工作方式(方式 0、1、2),2.控制端口D,3.数据总线缓冲器(引脚D0D7),由1个8位双向三态缓冲器构成 8255A内各端口通过数据缓冲器与系统总线相连。CPU与端口A、B、C间传送的数据,以及CPU写入控制端口D中的控制字均通过数据缓冲器传送。,4.读写控制电路(引脚CS、RD、WR),控制数据总线缓冲器的状态。数据总线缓冲器有3种状态:输入、输出、高阻态,5.片内译码电路(引脚A1、A0),选
12、择被操作的端口,8255A 操作地址,写控制字地址 A1=1、A0=1 A端口读写地址 A1=0、A0=0 B端口读写地址 A1=0、A0=1 C端口读写地址 A1=1、A0=0 注:写控制字操作仅有写操作,其余可读写 PC/XT机中地址为60H 63H,8255A 的工作方式控制字,例,A端口方式 1 输入、B 端口方式 1 输出、PC6,PC7 作输入,给出方式控制字。,BCH,A7H,A端口方式 1 输出、B 端口方式 1 输入、PC4,PC5 作输出,给出方式控制字。,例,8255A与系统的连线如下,片选译码地址为0F00F3H1)确定各端口地址?2)编程设置8255A:A口方式 0
13、输入,PC7PC4输出 B口方式 0 输出,PC3PC0输入,最后得出结论:A口地址为 F0 H B口地址为 F1 H C口地址为 F2 H D口地址为 F3 H,由8255A编程结构知:,解:1)端口地址,所以,方式控制字为 1001 0001B,即91H,要求设置:A口方式0输入,PC7PC4输出 B口方式0输出,PC3PC0输入,2)确定方式控制字,MOV AL,91H;方式控制字OUT 0F3H,AL,初始化程序,C端口置/复位控制字,通过控制口置 PC2 为 0,置 PC4 为 1解:MOV DX,0FF06H;置DX为控制口地址 MOV AL,0000 0100B;置PC2为0 O
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