时序逻辑电路-计数器.ppt
《时序逻辑电路-计数器.ppt》由会员分享,可在线阅读,更多相关《时序逻辑电路-计数器.ppt(25页珍藏版)》请在三一办公上搜索。
1、21.3 计数器(Counter),21.3.1 计数器的特点和分类,一、计数器的功能及应用,1.功能:,对时钟脉冲 CP 计数。,2.应用:,分频、定时、产生节拍脉冲和脉冲序列、进行数字运算等。,二、计数器的特点,1.输入信号:,计数脉冲 CP,Moore 型,2.主要组成单元:,时钟触发器,三、计数器的分类,按数制分:,二进制计数器十进制计数器N 进制(任意进制)计数器,按计数方式分:,加法计数器减法计数器可逆计数(Up-Down Counter),按时钟控制分:,同步计数器(Synchronous)异步计数器(Asynchronous),按开关元件分:,TTL 计数器CMOS 计数器,2
2、1.3.2 二进制计数器,计数器计数容量、长度或模的概念,计数器能够记忆输入脉冲的数目,即电路的有效状态数 M。,3 位二进制同步加法计数器:,0000,1111,/1,4 位二进制同步加法计数器:,000,111,/1,n 位二进制同步加法计数器:,一、二进制同步计数器,(一)3 位二进制同步加法计数器,FF2、FF1、FF0,Q2、Q1、Q0,设计方法一:,000,/0,001,010,011,100,101,/0,/0,/0,/0,110,/0,111,/0,/1,解,选用下降沿触发的 JK 触发器,时钟方程,输出方程,状态方程,1,0,0,1,1,1,0,0,0,1,1,1,1,0,0
3、,0,0,0,1,0,1,0,1,1,JK 触发器特性方程,求驱动方程,得,逻辑图,串行进位,触发器负载均匀,(四)集成二进制同步计数器(掌握),1.集成 4 位二进制同步加法计数器,引脚排列图,逻辑功能示意图,0 0 1 1,Q3 Q0=0000,同步并行置数,异步清零,Q3 Q0=D3 D0,1)74LS161,74161功能表,D 触发器构成的 T 触发器(D=Q),下降沿触发,若改用上升沿触发的 D 触发器?,5.2.3 十进制计数器,(8421BCD 码)(掌握),一、十进制同步计数器,(一)十进制同步加法计数器*,状态图,时钟方程,输出方程,状态方程,选择下降沿、JK 触发器,驱动
4、方程,J0=K0=1,J2=K2=Q1nQ0n,J3=Q2nQ1nQ0n,K3=Q0n,逻辑图,检查能否自启动,将无效状态1010 1111代入状态方程:,1010,1011,0100,1110,1111,1000,1100,1011,0100,能自启动,(四)集成十进制同步计数器(*),74160、74162,(引脚排列与74161相同),异步清零功能:,(74162 同步清零),同步置数功能:,同步计数功能:,保持功能:,进位信号保持,进位输出低电平,1.集成十进制同步加法计数器,二、十进制异步计数器(掌握),(三)集成十进制异步计数器,异步清零功能,异步置“9”功能,异步计数功能,M=2
- 配套讲稿:
如PPT文件的首页显示word图标,表示该PPT已包含配套word讲稿。双击word图标可打开word文档。
- 特殊限制:
部分文档作品中含有的国旗、国徽等图片,仅作为作品整体效果示例展示,禁止商用。设计者仅对作品中独创性部分享有著作权。
- 关 键 词:
- 时序 逻辑电路 计数器
![提示](https://www.31ppt.com/images/bang_tan.gif)
链接地址:https://www.31ppt.com/p-6167935.html