微机原理第五章半导体存储器.ppt

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1、微机原理与接口 第五章 半导体存储器,第五章 半导体存储器 2,主要内容,5.1 概述,5.2 随机存取存储器RAM,5.3 只读存储器ROM,5.4 存储器芯片与CPU的连接,5.5 高速缓冲存储器Cache,第五章 半导体存储器 3,5.1 概述,5.1.1 存储系统的基本概念5.1.2 存储器的分类5.1.3 存储器的主要性能指标5.1.4 存储器的组成结构,第五章 半导体存储器 4,5.1.1 存储系统的基本概念,存储器是一种接收、保存和取出信息（程序、数据、文件）的设备；一种具有记忆功能的部件；是计算机的重要组成部分，是CUP最重要的系统资源之一。CPU与存储器的关系如下图所示。,存

2、储器,CPU,第五章 半导体存储器 6,5.1.2 存储器的分类,按构成存储器的器件和存储介质分类按存储器存取方式分类按在微机系统中位置分类,第五章 半导体存储器 7,按存放信息原理不同,5.1.2 存储器的分类,按构成存储器的器件和存储介质分类：,磁芯存储器、半导体存储器、光电存储器、磁膜、磁泡和其它磁表面存储器以及光盘存储器等。,按存储器存取方式分类：,随机存取存储器RAM(Random Access Memory),只读存储器ROM(Read-Only Memory),又称读写存储器，指能够通过指令随机地、个别地对其中各个单元进行读/写操作的一类存储器。,在微机系统的在线运行过程中，只能

3、对其进行读操作，而不能进行写操作的一类存储器。,静态RAM动态RAM,掩膜ROM（MROM）可编程ROM（PROM）可擦除编程ROM（EPROM）,按工艺不同,第五章 半导体存储器 8,5.1.2 存储器的分类,按在微机系统中的位置分类：,主存储器（内存，Main Memory）,辅助存储器（外存，External Memory）,用来存放计算机正在执行的或经常使用的程序和数据。CPU可以直接对它进行访问。一般是由半导体存储器构成，通常装在主板上。存取速度快，但容量有限，其大小受地址总线位数的限制。,缓冲存储器（缓存，Cache Memory）,用来存放不经常使用的程序和数据，CPU不能直接访

4、问它。属计算机的外部设备,是为弥补内存容量的不足而配置的，容量大，成本低，所存储信息既可以修改也可以长期保存，但存取速度慢。需要配置专门的驱动设备才能完成对它的访问，如硬盘、软盘驱动器等。,位于主存与CPU之间，其存取速度非常快，但存储容量更小，可用来解决存取速度与存储容量之间的矛盾，提高整个系统的运行速度。,第五章 半导体存储器 9,5.1.2 存储器的分类,小结,第五章 半导体存储器 10,5.1.3 存储器的主要性能指标,存储器性能指标主要有：存储容量、存储速度、可靠性、功耗,存储容量：反映存储器可存储信息量的指标。以字数每个字的字长表示。如 某存储器存储容量为64K8位，即64K字节。

5、,存储速度：完成一次访问（读/写）存储器的时间。,可靠性：可靠性是用平均故障间隔时间MTBF来衡量。,存取时间TA（Access Time）表示启动一次存储操作到完成该操作 所经历时间；存储周期TMC（Memory Cycle）两次独立的存储操作之间所需的 最小时间间隔。,功 耗：通常是指每个存储单元消耗功率的大小。,第五章 半导体存储器 11,微机系统中的存储器分层体系结构,简单的二层结构：内 存 外 存,微机系统中存储器采用分层体系结构的根本目的：协调速度、容量、成本三者之间的矛盾。,第五章 半导体存储器 12,完整的四层结构：寄存器 Cache 主存 辅存,cache-主存：解决高速度与

6、低成本的矛盾；主存-辅存：利用虚拟存储技术解决大容量与低成本的矛盾,只有主存（内存）占用CPU的地址空间！,第五章 半导体存储器 13,微机系统中分层的存储器结构,第五章 半导体存储器 14,5.1.4 存储器的组成结构,半导体存储器一般由以下部分组成：存储体、地址选择电路、输入输出电路、控制电路,存储体：矩阵形式保存数据。地址选择器：接受CPU送来的地址信号并对它进行译码，选择与此地址码相对应的存储单元，以便对该单元进行读写操作。（1）单译码适用于小容量存储器（2）双译码分为行译码与列译码I/O电路：控制信息的读出与写入（包含对I/O信号的驱动及放大处理功能）。控制电路：片选信号用以实现芯片

7、的选择。读/写控制电路则用来控制对芯片的读/写操作。,第五章 半导体存储器 15,静态随机存取存储器SRAM动态随机存取存储器DRAM,5.2 随机存取存储器RAM,RAM(Random Access Memory)意指随机存取存储器。其工作特点是：在微机系统的工作过程中，可以随机地对其中的各个存储单元进行读写操作。,第五章 半导体存储器 16,5.2.1 静态随机存取存储器SRAM,SRAM的六管基本存储单元,T1和T2组成双稳态触发器，用于保存数据。T3和T4为负载管。如A点为数据D，则B点为数据/D。,行选择线有效（高电 平）时，A、B处的数据信息通过门控管T5和T6送至C、D点。,列选

8、择线有效（高电 平）时，C、D处的数据信息通过门控管T7和T8送至芯片的数据引脚I/O。,集成度低，但速度快，价格高，常用做Cache。,列选择线,行选择线,第五章 半导体存储器 17,5.2.1 静态随机存取存储器SRAM,典型存储器静态RAM存储器芯片Intel 2114,（1）外部结构 A0-A9：10根地址信号输入引脚。：读写控制信号输入引脚，当为低电平时，使输入三态门导通，信息由数据总线通过输入数据控制电路写入被选中的存储单元；反之从所选中的存储单元读出信息送到数据总线。I/O1I/O4：4根数据输入输出信号引脚：低电平有效，通常接地址译码器的输出端。+5V：电源。GND：地。,地址

9、线数目A、数据线数目I/O与芯片容量（MN）直接相关：2114容量为：2104bit 即 1K4,第五章 半导体存储器 18,5.2.1 静态随机存取存储器SRAM,典型存储器静态RAM存储器芯片Intel 2114,（2）内部结构 存储矩阵：4096个存储电路（6464矩阵）地址译码器：输入为10根线，采用两级译码方式，其中6根用于行译码，4根用于列译码；I/O控制电路：分为输入数据控制电路和列IO电路，用于对信息的输入输出进行缓冲和控制；片选及读写控制电路：用于实现对芯片的选择及读写控制。,第五章 半导体存储器 19,5.2.2 动态随机存取存储器DRAM,集成度高，但速度较慢，价格低，一

10、般用作主存,电容上存有电荷时，表示存储数据A为逻辑1；行选择线有效时，数据通过T1送至B处；列选择线有效时，数据通过T2送至芯片的数据引脚I/O；为防止电容C放电导致数据丢失，必须定时刷新；动态刷新时行选择线有效，列选择线无效（刷新逐行进行）。,刷新放大器,DRAM的单管基本存储单元,基本工作原理：依靠T1管栅极电容的充放电原理来保存信息。,第五章 半导体存储器 20,5.2.2 动态随机存取存储器DRAM,典型存储器动态RAM存储器芯片Intel 2164A,（1）外部结构 A0A7：地址信号的输入引脚，用来分时接收CPU送来的8位行、列地址；：行地址选通信号输入引脚，低电平有效，兼作芯片选

11、择信号。当为低电平时，表明芯片当前接收的是行地址；：列地址选通信号输入引脚，低电平有效，表明当前正在接收的是列地址(此时应保持为低电平)；：写允许控制信号输入引脚，当其为低电平时，执行写操作；否则，执行读操作。DIN：数据输入引脚；DOUT：数据输出引脚；VDD：十5V电源引脚；Css：地；N/C：未用引脚。,第五章 半导体存储器 21,5.2.2 动态随机存取存储器DRAM,典型存储器动态RAM存储器芯片Intel 2164A,（2）内部结构 存储体：64K1；地址锁存器：Intel 2164A采用双译码方式，其16位地址信息要分两次送入芯片内部，在芯片内部有一个能保存8位地址信息的地址锁存

12、器；数据输入缓冲器：用以暂存输入的数据；数据输出缓冲器：用以暂存要输出的数据；1/4I/O门电路：由行、列地址信号的最高位控制，能从相应的4个存储矩阵中选择一个进行输入输出操作；,第五章 半导体存储器 22,5.2.2 动态随机存取存储器SRAM,典型存储器动态RAM存储器芯片Intel 2164A,（2）内部结构 行、列时钟缓冲器：用以协调行、列地址的选通信号；写允许时钟缓冲器：用以控制芯片的数据传送方向；128读出放大器：与4个128128存储阵列相对应，接收由行地址选通的4128个存储单元的信息，经放大后，再写回原存储单元，是实现刷新操作的重要部分；1/128行、列译码器：分别用来接收7

13、位的行、列地址，经译码后，从128128个存储单元中选择一个确定的存储单元，以便对其进行读/写操作。,第五章 半导体存储器 23,掩模式ROMMROM（Mask ROM）可编程ROMPROM（Programmable ROM）可擦除可编程ROMEPROM（Erasable Programmable ROM）电可擦除可编程ROMEEPROM（Electrically Erasable Programmable ROM）快擦型存储器(F1ash Memory),5.3 只读存储器ROM,ROM(Read Only Memory)意指只读存储器。其工作特点是：在微机系统的在线运行过程中，只能对其进行

14、读操作，而不能进行写操作。电源关断，信息不会丢失，属于非易失性存储器件；常用来存放不需要改变的信息。,第五章 半导体存储器 24,5.3.1 掩模式ROMMROM,MROM是厂家根据用户事先编写好的机器码程序，把0、1信息存储在掩模图形中而制成的芯片。芯片制成后，存储位的状态即0、1信息就被固定了。,优点：可靠性高，集成度高，价格便宜，适宜大批量生产。缺点：不能重写。,第五章 半导体存储器 25,5.3.2 可编程ROMPROM,PROM一种可由用户通过简易设备写入信息的ROM器件。,存储原理：（1）二极管破坏型PROM（2）熔丝式PROM PROM可由用户根据自己的需要来确定ROM中的内容，

15、常见的熔丝式PROM是以熔丝的接通和断开来表示所存的信息为1或0。,PROM器件只能固化一次程序，数据写入后，就不能再改变了！一次性！,第五章 半导体存储器 26,5.3.3 可擦除可编程ROMEPROM,紫外线擦除可编程ROM的英文全称为Ultraviolet Erasable Programmable ROM，即UV EPROM，通常为了简便，缩写为EPROM。它的存储内容可以根据需要写入，当需要更新内容时，可以使用紫外线照射的方法擦除原来写入的数据，再写入新的内容。,第五章 半导体存储器 27,5.3.3 可擦除可编程ROMEPROM,典型EPROM 芯片Intel 2716（2K8）,

16、（1）外部结构 Al0A0：地址信号输入引脚，可寻址芯片的2K个存储单元；O7O0：双向数据信号输入输出引脚；：片选信号输入引脚，低电平有效，只有当该引脚转入低电平时，才能对相应的芯片进行操作；：数据输出允许控制信号引脚，输入，低电平有效，用以允许数据输出；Vcc：+5v电源，用于在线的读操作；VPP：+25v电源，用于在专用装置上进行写操作；GND：地。,第五章 半导体存储器 28,5.3.4 电子可擦除可编程ROME2PROM,EEPROM也可写成E2PROM，它的编程原理与EPROM相同，但可用电擦除，重复改写的次数有限制（因氧化层被磨损），一般为10万次。,擦除可以按字节分别进行；可以

17、进行在线的编程写入（字节的编程和擦除都只需要10ms，并且不需特殊装置）,第五章 半导体存储器 29,5.3.5 闪速存储器(F1ash Memory),Flash Memory闪速存储器、快擦型存储器：是不用电池供电的、高速耐用的非易失性半导体存储器。其特点是：可以整体电擦除（时间1S）和按字节重新高速编程。是完全非易失性的，可以完全代替E2PROM。能进行高速编程。如:28F256芯片，每个字节编程需100s，整个芯片0.5s；最少可以擦写一万次，通常可达到10万次；低功耗，最大工作电流30mA。与E2PROM进行比较具有容量大、价格低、可靠性高等明显优势。快擦型存储器还可应用于激光打印机

18、、条形码阅读器、各种仪器设备以及计算机的外部设备中。典型的芯片有27F256/28F016/28F020等。,第五章 半导体存储器 30,只读存储器ROM分类,目前取代传统的EPROM和EEPROM的主要的存储器,第五章 半导体存储器 31,5.4 存储器芯片与CPU的连接,5.4.1 存储芯片的扩展5.4.2 存储器芯片与CPU的连接,如何用容量较小、字长较短的芯片组成微机系统所需容量和字长的存储器？,第五章 半导体存储器 32,32,用多片存储芯片构成一个需要的内存空间；各存储器芯片在整个内存中占据不同的地址范围；任一时刻仅有一片（或一组）被选中。存储器芯片的存储容量等于：单元数每单元的位

19、数,字节数,字长,扩展单元,扩展字长,5.4.1 存储芯片的扩展,第五章 半导体存储器 33,5.4.1 存储芯片的扩展,存储器的容量：字节数字长,第五章 半导体存储器 34,5.4.1 存储芯片的扩展,位扩展（字长的扩展）,【例1】用1K4的2114芯片构成lK8的存储器系统。,分析：每个芯片只能提供4位数据，故需用2片这样的芯片，它们分别提供4位数据至系统的数据总线，以满足存储器系统的字长要求。,设计要点：关键是处理好地址线、数据线、写信号线、片选信号线 的连接。,（1）地址线共用（至系统地址总线低10位）；（2）数据线分别接入系统数据总线的低4位和高4位；（3）端并在一起接至系统的存储器

20、写信号；（4）端并在一起接至地址译码器输出。,第五章 半导体存储器 35,5.4.1 存储芯片的扩展,字扩展（字数的扩展）,【例2】用2K8的2716存储器芯片组成8K8的存储器系统。,分析：每个芯片只能提供2K个存储单元，故需用4片这样的芯片，以满足存储器系统的字数要求。,（1）地址线共用（至系统地址总线低11位）；（2）数据线共用（至系统数据总线）；（3）端并在一起接至系统的存储器写信号；（4）端分别接至地址译码器的不同输出。,设计要点：关键是处理好地址线、数据线、写信号线、片选信号线 的连接。,2716,2716,2716,2716,第五章 半导体存储器 36,5.4.1 存储芯片的扩展

21、,字位同时扩展,【练习】用1K4的2114芯片组成2K8的存储器系统。,将上述两种方法结合使用，一般先扩展字长，在扩展字数。,第五章 半导体存储器 37,存储器容量扩展：根据内存容量及芯片容量确定所需存储芯片数；进行位扩展以满足字长要求；进行字扩展以满足容量要求。若已有存储芯片的容量为LK，要构成容量为 M N的存储器，需要的芯片数为：（M N）（LK）,第五章 半导体存储器 38,5.4.2 存储芯片与CPU的连接,CPU对存储器进行读写操作过程：首先要由地址总线给出地址信号，选择要进行读/写操作的存储单元，然后通过控制总线发出相应的读/写控制信号，最后才能在数据总线上进行数据交换。,存储器

22、芯片与CPU之间的连接，实质上就是其与系统总线的连接。包括：地址线的连接；数据线的连接；控制线的连接。,第五章 半导体存储器 39,一、存储器与CPU连接时应注意问题,1.CPU总线的负载能力。,第五章 半导体存储器 40,40,2.CPU的时序和存储器芯片存取速度的配合,第五章 半导体存储器 41,41,3.存储器的地址分配和选片问题。,第五章 半导体存储器 42,42,4.控制信号的连接,第五章 半导体存储器 43,43,二、片选信号的产生,第五章 半导体存储器 44,第五章 半导体存储器 45,45,1.线选法：,第五章 半导体存储器 46,46,另一种常用的线选法是用高位地址的每一根线

23、去分别控制各组芯片的片选端，如下图所示：,第五章 半导体存储器 47,47,下图为线选法的例子，令A13和A14分别接芯片甲和乙的片选端。可能的选择只有10（选中芯片甲）和01（选中芯片乙）。,线选法,A19A15因未参与对2个2764的片选控制，故其值可以是0或1（用x表示任取），这里，假定取为全0，则得到了两片2764的地址范围如图中所示，显然2片2764的重叠区各有25=32个。,第五章 半导体存储器 48,48,全译码法中，对剩余的全部高位地址线进行译码称为全译码法。,2.全译码法：,第五章 半导体存储器 49,49,在译码法中，只对剩余的高位地址线的某几根进行译码，称为部分译码法。,

24、3.部分译码法(局部译码法)：,第五章 半导体存储器 50,50,芯片 A19 A15 A14A12 A11 A0 一个可用地址范围 1 00 000 全0全1 0000000FFFH 2 00 001 全0全1 0100001FFFH 3 00 010 全0全1 0200002FFFH 4 00 011 全0全1 0300003FFFH,部分译码,图示的电路，采用部分译码对4个2732芯片（4K8位，EPROM）进行寻址。译码时，未使用高位地址线A19、A18和A15。所以，每个芯片将同时具有23=8个可用且不同的地址范围（即重叠区）。,第五章 半导体存储器 51,三、译码器74LS138,

25、第五章 半导体存储器 52,（1）地址线共用（至系统地址总线低位）；（2）数据线共用（至系统数据总线）；（3）写信号端并在一起接至系统的存储器写信号；（4）片选端分别接至地址译码器的不同输出。,小结与习题：,（1）地址线共用（至系统地址总线低位）；（2）数据线分别接入系统数据总线的低4位和高4位；（3）写信号 端并在一起接至系统的存储器写信号；（4）片选端并在一起接至地址译码器输出。,位扩展,字扩展,掌握内容存储器扩展；存储器与CPU的连接；片选信号理解内容存储器的分类及性能指标；半导体存储器的引脚特性；微机系统内存储器的分层体系结构了解内容存储器的发展；半导体存储器的内部结构；,第五章 半导体存储器 53,习题与思考：,1试说明存储器系统的主要性能指标。2微型计算机中常用的存储器有哪些类型？它们各有何特点？分别适用于哪些场合？3存储器的哪一部分用来存储程序指令及像常数和查找表一类的固定不变的信息？哪一部 分用来存储经常改变的数据？4试比较静态RAM和动态RAM的优缺点。5术语“非易失性存储器”是什么意思？试简述ROM器件的发展过程。6、用2K8的2716存储器芯片组成8K8的存储器系统。试绘出存储器扩展图（分析、设计要点和连接图）。,