计算机基础知识治疗SA.ppt

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1、计算机组成原理第3章 系统总线,李曦（）,本章内容,3.1 总线的概念和分类3.2 总线特性及性能指标总线特性性能指标总线标准3.3 总线的结构3.4 总线控制判优控制通信控制,3.1 总线的基本概念和分类,计算机部件,读写控制信号地址线数据线握手信号状态、中断、DMA时钟、电源、地线,系统互联,分散连接内部连线十分复杂，布线困难扩展性差效率高总线连接简洁扩展性好共享竞争1970年DEC公司PDP-11小型计算机首次采用总线技术,总线,定义：是连接多个部件的传输线总线的关键特征是共享传输线。总线的两个特点：任意时刻只能有一个设备向总线发送信息系统瓶颈多个部件可以同时从总线接受相同的信息广播式,

2、总线分类按位置,片内总线是指芯片内部的总线。如在CPU芯片内部，寄存器和寄存器之间、寄存器和算逻单元ALU之间都有总线连接。系统总线是指CPU、主存、I/O（通过I/O接口）各大部件之间的信息传输线。又叫板级总线和板间总线如ISA、PCI等。通信总线（I/O总线）是指计算机系统之间或计算机系统与其他系统（如控制仪表等）之间的通信传输线。IDE、SCSI、USB、RS232,总线分类按功能,数据总线（DB）双向，宽度差别地址总线（AB）单向，宽度与寻址空间有关控制总线（CB）命令和状态,总线也包括电源线和地线！,数据总线,数据总线上传送数据信息，数据总线是双向的。数据总线的条数称为数据总线宽度。

3、比如，16位总线，指其数据总线为16根。数据总线是三态的，未被地址信号选中的部件，不驱动数据总线（其数据引脚为高阻）。,控制总线,控制总线上传送一个部件对另一个部件的控制信号。主设备与从设备：在总线上所连接的各类设备，按其对总线有无控制功能可分为主设备和从设备。主设备对总线有控制权，从设备只能响应主设备发来的总线命令。这样，总线上所有的信息传输都是由主设备启动的。根据不同的使用意义，控制总线上有的信号线为三态，有的非三态。,地址总线,地址总线上传送地址信号，主要用来指定需要访问的部件（如存储器单元、外设）。总线主设备发出地址信号后，总线上的所有部件均感受到该地址信号，但只有经过译码电路选中的部

4、件才接收主设备的控制信号，并与之通信。地址总线是单向的，即地址信号只能由总线主设备至从设备。地址总线也是三态的，非主设备部件不能驱动地址总线。,3.2 总线特性及性能指标,总线特性性能指标总线标准,总线特性(1),从物理角度来看，总线就是一组电导线。为了保证机械上的可靠连接，必须规定其机械特性；为了保证电气上正确连接，必须规定其电气特性；为了保证正确地连接不同部件，还需规定其功能特性和时间特性。,总线,总线特性(2),机械特性：是指总线在机械连接方式上的一些性能。如插头和插座使用的标准，它们的几何尺寸、形状、引脚的个数以及排列的顺序，接头处的可靠接触等等。电气特性：是指总线的每一根传输线上信号

5、的传输方向和有效的电平范围。如低电平表示逻辑“1”，并要求电平低于3V；高电平表示逻辑“0”，并要求高电平高于3V。功能特性：是指总线中每根信号传输线的功能。时间特性：是指总线中的任一根信号传输线在什么时间内有效。为了正确传输数据信息，每条总线上的各种信号，互相存在着一种有效时序的关系，因此，时间特性一般可用信号时序图来描述。,总线性能指标(1),总线宽度：是指数据总线的根数，用bit（位）表示，如8位、16位、32位、64位（也即8根、16根、32根、64根数据线）。最大传输率(总线带宽)：总线本身所能达到的最高传输速率，用MB/s（每秒多少兆字节）表示。例：总线工作频率33.3MHz，总线

6、宽度32位，则最大传输率 33.332/8132MB/s。时钟同步/异步：总线上的数据与时钟同步工作的总线称为同步总线，与时钟不同步工作的总线称为异步总线。总线复用：为提高总线的利用率，将地址总线和数据总线共用一组物理线，在某一时刻该总线传输地址信号，另一时刻传输数据信号或命令信号。,总线性能指标(2),信号线数：即地址总线、数据总线和控制总线三种总线的根数总和。总线控制方式：包括并发工作、自动配置、仲裁方式、逻辑方式、计数方式等。负载能力：通常用可连接扩增电路板数来反映总线的负载能力。由于不同的电路对总线的负载是不同的，即使同一电路在不同的工作频率下，总线的负载也是不同的。因此，总线负载能力

7、的指标是不太严格的。其他：如电源电压是5V还是3.3V、总线能否扩展至64位宽度等。,总线标准的产生,总线是在计算机系统模块化的发展过程中产生的，随着计算及应用领域的不断扩大，计算机系统中各类模块（特别是I/O设备所带来的各类接口模块），其品种极其繁杂，往往出现一种模块要配一种总线，很难在总线上更换、组合各类模块或设备。20世纪70年代末，为了使系统设计简化，模块生产批量化，确保其性能稳定，质量可靠，便于维护，人们开始研究如何建立总线标准，完成系统设计和模块制作。概念：所谓总线标准，可视为系统与各模块、模块与模块之间的一个互连的标准界面。这个界面两端的任一方只需根据总线标准的要求完成自身一面接

8、口的功能要求，而无需了解对方接口与总线的连接要求。因此，按总线标准设计的接口可视为通用接口。,目前流行的总线标准,ISAEISAVESAPCIMCASTD,ISA、EISA,ISA：Industry Standard Architecture工业标准体系结构，又称AT总线24位地址线（可直接寻址的内存容量为16MB）62+36引脚8/16位数据线最高时钟频率8MHz最大传输率16MB/sEISA：Extended Industry Standard Architecture 扩展工业标准体系结构EISA是一种在ISA基础上扩充开放的总线标准地址总线32位数据总线32位总线的时钟频率为8MHz最

9、大传输率33MB/s,MCA、STD,MCA：Micro Channel Architecture微通道体系结构，32位标准总线，最大传输率40MB/s。MCA是IBM公司在推出其第一台80386系统时，突破传统ISA标准而创建的新型系统总线标准。MCA与ISA完全不兼容，所以限制了其推广。STD：STD总线于1987年被国际电子电气工程师协会（IEEE）列为标准（IEEE961标准），主要用于以微处理器为中心的工业控制领域。数据总线8位，最大传输率2MB/S。,VL-BUS、PCI,VL-BUS：是由VESA（Video Electronic Standard Association，视频电

10、子标准协会）提出来的局部总线标准，也称为 VESA总线。数据总线32位总线时钟频率33MHz配有局部控制器，将高速设备直接挂在CPU的总线上，实现CPU与高速外设之间的高速数据交换PCI：Peripheral Component Interconnect外部设备互连总线。32/64位数据总线，总线时钟频率33MHz最大数据传输率132MB/s264MB/s与ISA、EISA均可兼容支持即插即用、支持多层结构,AGP、SCSI、USB,AGP：Accelerated Graphics Port加速图形接口，专为提高视频带宽而设计的总线规范。它采用点对点连接，连接控制芯片组和AGP显示卡，因此严格

11、说AGP不能称为总线，而是一种接口标准。SCSI：Small Computer System Interface小型计算机系统接口。SCSI总线主要用于光驱、音频设备、扫描仪、打印机以及像硬盘驱动器这样的大容量存储设备等的连接，是一种直接连接外设的并行I/O总线。USB：Universal Serial Bus通用串行总线，是一种连接外围设备的I/O总线，具有即插即用、热拔插等优良特点。,8位ISA总线接口,8088的引脚图,最小组态系统,16位ISA总线,3.3 总线的结构,单总线结构双总线结构多总线结构,单总线结构,单总线结构将CPU、主存、I/O设备（通过I/O接口）都挂到一组总线上，允

12、许I/O之间、I/O与主存之间直接交换信息。这种结构简单，便于扩充。但是，由于所有的传送都通过这组总线，容易形成计算机系统的瓶颈。,为了从根本上解决CPU、主存与I/O设备之间传输速率的不匹配问题，实现CPU与其他设备的相对同步，不得不采用多总线结构。,双总线结构,特点：将速度较低的I/O设备从单总线上分离出来，形成主存总线和I/O总线分开的结构。概念：通道是一个具有特殊功能的处理器,CPU将一部分功能下放给通道，使其对I/O设备具有统一管理功能，以完成外部设备与主存之间的数据传送，其系统的吞吐能力可以相当大。,如果将速率不同的I/O设备进行分类，然后将它们连接在不同的通道上，那么计算机系统的

13、利用率会更高，如此发展成多总线结构。,三总线结构,主存总线I/O总线DMA总线主存总线与DMA总线不能同时对主存进行存取。,四总线结构,为了进一步提高I/O的性能，又出现了四总线结构。局部总线、系统总线、高速总线、扩展总线,PCI总线结构,多层PCI总线结构,典型总线接口,Pentium计算机主板总线结构图,CPU、RAM、ROM、控制芯片组等芯片之间的信号连接线称为CPU总线。CPU总线针对具体处理器设计，因此没有统一的规范。,这是一个三总线结构，即有CPU总线、PCI总线和ISA总线。,CPU总线的时钟频率为66.6MHz，CPU内部时钟是此时钟频率的倍频。此总线可连接4-128M内存。,

14、主存控制器和Cache控制器芯片用来管理CPU对主存和Cache的存取操作。,PCI总线用来连接高速的I/O设备模块，如显卡等。通过“桥”芯片，PCI总线上连CPU总接，下连ISA总线。,ISA总线连接低速IO设备，支持7个DMA通道和15级可屏蔽硬件中断。,CPU总线、PCI总线和ISA总线通过两个“桥”芯片连成整体。桥芯片起到了信号速度缓冲、电平转换和控制协议转换的作用。,南北桥结构的KT133芯片组,多处理器系统的PCI配置,3.4 总线控制,总线判优控制总线通信控制,总线传输过程,总线完成一次传输可分为4个阶段申请分配阶段：由需要使用总线的主设备提出申请，经总线仲裁机构决定将下一传输周

15、期的总线使用权授于某一申请者。寻址阶段：取得了使用权的主设备，通过总线发出本次打算访问的从设备的存储地址或设备地址及有关命令，启动参与本次传输的从设备。传数阶段：主设备和从设备进行数据交换。结束阶段：从总线上撤除有关信息，让出使用权。对于独占系统（只有一个主设备的简单系统），只有2、3两个阶段,总线控制,两个问题总线使用权分配，即总线判优控制，也称为仲裁逻辑通信过程控制总线判优控制：多个主设备同时申请总线时，按一定的优先等级顺序确定哪个主设备能使用总线。集中式：将控制逻辑集中在一处，即总线仲裁器（arbitrator），分为链式查询、计数器定时查询、独立请求三种分布式：将控制逻辑分散在与总线连

16、接的各个部件或设备上，由各个节点竞争使用权（network）总线通信控制同步通信、异步通信、半同步通信、分离式通信,总线判优控制集中式,链式查询方式,总线判优控制集中式,链式查询方式的主要特点：越靠近控制器的模块，优先级越高；链形优先级存在传播延迟，这种延迟与模块数成正比，所以判优速度较慢，一般只接少量（几个）模块；链形结构，一个故障，链失效；结构较简单，造价较低。,总线判优控制集中式,总线请求BR,总线忙BS,I/O接口0,I/O接口1,总线控制器,计数器定时查询方式,I/O接口n,数据线,地址线,设备地址,总线判优控制集中式,计数器定时查询方式的主要特点：计数方式与优先次序直接相关。计数可

17、以从“0”开始，此时设备的优先次序是固定的；计数也可以从终止点开始，即是一种循环方法，此时设备使用总线的优先级相等；计数的初始值还可由程序设置，故优先次序可以改变。对电路故障不如链式查询方式敏感，但增加了主控制线（设备地址），控制也较复杂。,总线判优控制集中式,BR0,BG0,I/O接口0,I/O接口1,总线控制器,独立请求方式,I/O接口n,数据线,地址线,BG1,BRn,BR1,BGn,总线判优控制集中式,独立请求方式的工作原理：每个模块有一组独立的“总线请求”和“总线允许”信号线，每对信号线有其相应的优先级；控制器中有一个优先级编码器和优先级译码器，用以选择优先级最高的请求，并产生出相应

18、的“总线允许”信号；当“总线忙”信号有效时，表示有的模块正在使用总线，因此请求使用总线的模块必须等待；直至“总线忙”信号变为无效时，所有需要使用总线的模块都可以发出“总线请求”信号，总线仲裁器仅向优先级最高的模块发出“总线允许”信号。独立请求方式的主要特点：判优速度快，且与模块数无关；所需“请求线”和“允许线”较多，N个模块需要2N条。,总线判优控制分布式,分布式仲裁不需要中央仲裁器，有三种常见的仲裁方式：自举分布式仲裁冲突检测分布式仲裁并行竞争分布式仲裁,总线判优控制分步式,自举分布式仲裁,自举分布式仲裁方法使用多个请求线不需要中心裁决器每个设备独立地决定自己是否是最高优先级请求者。每个需要

19、请求总线控制权的设备在各自的总线请求线上送出请求信号在总线裁决期间，每个设备将有关请求线上的信号合成后取回分析，根据这些请求信号确定自己能否拥有总线控制权。每个设备通过取回的合成信息能够检测出其他设备是否发出了总线请求。如果一个设备在发出总线请求的同时，检测到其他优先级更高的设备也请求使用总线，则本设备不立即使用总线；否则，本设备就可立即使用总线。NuBus（Macintoshi II中的底板式总线）和SCSI总线采用此方案。,总线判优控制分布式,自举分布式仲裁,BR3,BR2,I/O接口0,I/O接口1,I/O接口3,BR0,BR1,I/O接口2,假定：I/O接口0的优先级最低，I/O接口3

20、的优先级最高。BR0为总线忙信号线BRi(i从13)为I/O接口i的总线请求信号线。,总线判优控制分布式,基本思想：在冲突检测分布式仲裁方法中，每个设备独立地请求总线，多个同时使用总线的设备会发生冲突，这时冲突被检测到，按照某种策略在冲突的各方选择一个设备。Ethernet总线仲裁方案（CDMA/CD）先听后讲边讲边听随机重发,冲突检测分布式仲裁,总线判优控制分布式,并行竞争分布式仲裁,基本思想：总线上的每个设备都有唯一的仲裁号。需要使用总线的设备把“仲裁号”发到仲裁线上设备根据并行竞争算法决定是否获得总线使用权发送最大仲裁号的设备将获得总线使用权。8位，可以表示256个优先级。仲裁号为255

21、的设备优先级最高，而最低与自举分布式仲裁算法相比，可以用很少的仲裁线挂接大量的设备。Futurebus+总线标准采用这种仲裁方案。,总线判优控制分布式,仲裁算法：每个设备的仲裁逻辑将检查仲裁线上的结果值，并根据下列规则修改它放到总线上的仲裁号：如果该设备的仲裁号中有某一位为0，而这一位对应的仲裁线信号为1，则修改这个仲裁号，使其所有低位都从总线上撤销（送出一个“0”）。这样，具有最高仲裁号的设备将会发现它的仲裁号和留在仲裁线上的号匹配，所以它将赢得总线使用权。,并行竞争分布式仲裁,两个设备同时要求使用总线，仲裁号分别是00000101和00001010；最终留在仲裁线上的号为00001010。

22、,表7.1 并行竞争裁决逻辑举例分析结果,循环菊花链(Round Robin Daisy Chaining),分布式仲裁获准接管总线总线的模块同时兼作当前的总线仲裁器每个模块的优先权取决于它沿总线允许信号BG传输方向距当前总线控制器的远近,总线使用权分配小结,选择不同裁决方案的因素：总线在I/O设备的数量和总线长度的可扩充性方面如何？总线裁决应该多快？需要什么程度的公正性等。集中式、分布式优先级固定、优先级可变公平性问题自举式：优先级固定冲突检测式：公平，无优先级并行竞争式：优先级固定,同步通信方式,通信双方由统一时标控制数据传送称为同步通信。时标通常由CPU的总线控制部件发出，送到总线上的所

23、有部件；也可以由每个部件各自的时序发生器发出，但是必须有总线控制部件发出的时钟信号对它们进行同步。,对于读命令，其传输周期为：T1：主模块发地址T2：主模块发读命令T3：从模块提供数据T4：主模块撤销读命令,同步通信方式,对于写命令，其传输周期为：T1：主模块发地址T1.5：主模块提供数据T2：主模块发写命令，从模块必须在规定时间内将数据写入地址总线所指明的单元中T4：主模块撤销写命令和数据等信号,同步通信方式的优点与缺点:优点是模块间的配合简单一致；缺点是主从模块时间配合属强制性同步，必须按速度最慢的部件来设计公共时钟。,同步通信协议（读操作）,总线周期、时钟周期,异步通信方式,异步通信方式

24、克服了同步通信的缺点，允许各模块速度的不一致性，给设计者充分的灵活性和选择余地。异步通信方式没有公共的时钟标准，而是采用应答方式（又称握手方式）：主设备发Request，从设备响应Ack；当然，这就要求主从模块之间要增加两条应答线。异步通信方式分为三种类型不互锁方式半互锁方式全互锁方式,异步通信方式的三种类型,不互锁方式主设备发Request后，间隔固定时间，认为从设备已经收到；从设备发ACK后，间隔固定时间，认为主设备也收到。半互锁方式主设备发Request后，等待ACK；从设备发ACK后，不等待主设备。全互锁方式主从设备相互等待,不互锁方式,半互锁方式,全互锁方式,请求,应答,请求,应答,

25、请求,应答,全互锁时序,异步通信协议,同步总线 vs.异步总线,半同步通信方式,按同步方式定时增加wait状态信号线在T2/T3之间插入Tw,以读命令为例，半同步通信时序为：T1：主模块发地址T2：主模块发读命令Tw：当WAIT信号为低电平有效时，进入等待，其时间间隔与T统一Tw：当WAIT信号为低电平有效时，进入等待，其时间间隔与T统一T3：从模块提供数据T4：主模块撤销读命令,半同步通信方式的特点,半同步通信方式集同步与异步通信之优点，适用于系统工作速度不高，但又包含了许多工作速度差异较大的各类设备的简单系统。半同步通信控制方式比异步通信简单，可靠性较高。半同步通信方式的缺点是对系统时钟频

26、率不能要求太高，故从整体上看，系统工作的速度还是不高。,分离式通信,在同步通信、异步通信和半同步通信的整个传输过程中，系统总线的使用权完全由占有使用权的主设备以及由它选中的从设备占据。读命令过程分析：进一步分析读命令传输周期，我们可以发现除了申请总线这一阶段外，其余时间主要被花在如下三个方面：（1）主模块通过传输总线向从模块发送地址和命令；（2）从模块按照命令进行读数据的必要准备；（3）从模块经数据总线向主模块提供数据。,分离事务通信协议,分离式通信,基本思想：将一个传输周期（或总线周期）分解为两个子周期。在第一个子周期中，主模块A获得总线使用权后将命令、地址、A模块的编号等其他信息发到系统总

27、线上，经总线传输后，由有关的从模块B接收下来。在第二个子周期中，当B模块接收到A模块发来的有关命令信号后，经过一序列内部操作，将A模块所需的数据准备好，然后由B模块申请总线使用权，一旦获准，B模块将A模块的编号、B模块的地址、A模块所需数据等信息送到总线上，供A模块接收。,分离式通信的特点,各模块欲占用总线使用权都必须提出申请。在得到总线使用权后，主模块在先规定的时间内向对方传送信息，采用同步方式传送，不再等待对方的回答信号。各模块在准备数据传送的过程中都不占用总线，使总线可接受其他模块的请求。总线在被占用时都在作有效工作。,总线事务,通常把在总线上一对设备之间的一次信息交换过程称为一个“总线

28、事务”Pentium Pro处理器总线的事务类型有11种。延迟回答：当一个从设备需要花很长时间才能完成某个事务时，就通过发出该“延迟回答”事务，以“分离事务”方式来处理该事务。中断响应：当处理器响应从8259中断控制器送来的中断请求而要去读中断向量时。特殊事务：当处理器要广播一条与某个内部事件（如：shutdown、halt等）有关的消息时。,存储器读并无效：处理器产生该“存储器读并无效”事务，主要是为了对一个Cache行进行独占访问。存储器代码读：当处理器要从存储器中取指令时。存储器数据读：当执行到某指令要从存储器中取数据时。分支跟踪消息：在指令执行过程中当一个转移目标的条件被满足时。它将送

29、出转移指令的地址和转移到的目标指令的地址。,I/O读：当处理器执行IN或INS指令，要从某个I/O设备读取数据或状态时。I/O写：当处理器执行OUT或OUTS指令，要将数据或命令写到某个I/O设备上时。存储器写（不可重试）：当处理器要写回一个更新的Cache行到存储器（淘汰）以便为一个新行腾出空间时，由处理器发出该事务。存储器写（可重试）：当处理器执行到某指令需写数据到存储器中去时，由处理器发出该事务。,总线事务的操作阶段,Pentium Pro处理器每个总线事务包含五个操作阶段请求阶段（地址阶段）送出地址信息和事务类型信息，以及有关事务的其他信息。检错阶段对请求阶段送出的地址和请求信息所对应

30、的奇偶校验信号进行检测。侦听阶段对请求阶段送出地址中所对应的数据，检查其在各个Cache中的命中状态，确定以后阶段如何处理该事务。响应阶段根据请求的事务类型、检错和侦听结果，确定如何响应当前事务。返回的响应结果可以是重试事务、延迟事务、硬件错、无数据传送事务、回写（Writeback）事务或正常数据传送事务等。数据阶段送数据到数据总线上，或从数据总线上取数据,例1,题目：某总线在一个总线周期中并行传送4个字节的数据，假设一个总线周期等于一个总线时钟周期，总线时钟频率为33MHz，则总线带宽是多少?如果一个总线周期中并行传送64位数据，总线时钟频率升为66MHz，则总线带宽是多少?解：设总线带宽

31、用Dr表示，总线时钟周期用T=1/f表示，一个总线周期传送的数据量用D表示，（1）根据定义可得 Dr=D/T=D1/T=Df=4B331000000/s=132MB/s（2）64位=8B，Dr=Df=8B661000000/s=528MB/s,提示：此题主要是考查对总线带宽的理解。总线带宽一次传输的字节数总线周期 总线宽度/8*总线时钟频率,总线带宽需求分析,例如：系统需求如下每秒30帧，每帧640*480，彩色数24位的图象显示卡的数据吞吐量为28M字节/s；100Mbps传输率的光纤网，需总线吞吐量为12.5M字节/s；,通信度量,平均速率56bits/1000ns56Mb/savgrat

32、e最大速率8bits/100ns80Mb/speakrate,总线数据传输方式,总线传输方式串行总线、并行总线传输一字节所使用的信道数串行、并行传输串并转换问题数据编码方式数据传输模式单字节传输突发传输,信息传送方式,并行、串行,数据编码方式,总线数据传输模式,单字节传输方式在一个传输周期内，一般是先给出地址，然后给出数据，在后面传输周期里，不断重复这种先送地址、后送数据的方式进行传输。突发传输方式（burstmode）在传输大批量地址连续的数据时，除了第一个周期先送首地址、后给出数据外，以后的传输周期内，不需要再送地址（地址自动加一）而直接送数据，从而达到快速传送数据的目的。,PCI总线单字

33、节数据传输模式,地址、数据复用,PCI总线突发数据传输模式,USB总线的编码方式,“见0就翻”,USB总线拓扑结构,USB外设的结构框图,USB接口技术,支持3种数据传输速率操作低速1.5Mb/s，全速12Mb/s和高速480Mb/s。支持4种类型的传输模式控制数据传送：在设备连接时对设备进行设置，还可对指定设备进行控制，如通道控制；两种类型的通道：流和消息。批量数据传送：大批量产生并使用的数据，在传输约束下，具有很广的动态范围；中断数据的传送：用来描述或匹配人的感觉或对特征反应的回馈。同步数据的传送：由预先确定的传送延迟来填满预定的USB 带宽。,USB数据传输,每一总线执行动作最多传送三个

34、数据包标志包(token packet)在每次传送开始时主机控制器发送，描述传输运作的种类、方向、USB 设备地址和终端号数据包握手包接收端表明是否传送成功可利用其进行流量控制,前端总线（Front Side Bus，FSB）,最新的INTEL和AMD多核处理器都不用FSB了都是基于PACKET的网络式通信方式INTEL的技术叫做QPI（QuickPath Interconnect）AMD的叫HT（HyperTransport）Intel的QPI（快速通道互联）事实上它的官方名字叫做CSI（Common System Interface，公共系统界面）用来实现芯片之间的直接互联，而不是在通过F

35、SB连接到北桥，矛头直指AMD的HT总线。无论是速度、带宽、每个针脚的带宽、功耗等一切规格都超越HT总线。,下一代总线的发展状况,基于IA体系的总线也在向着多处理器、跨系统、平滑网络与计算机系统间的连接的方向发展,3GIO总线,3GIO总线（Arapahoe总线）是一个双向对称总线，它具有高达2.5 GB/s的数据传输率。采用Host主桥和交换器。具有可变带宽。支持32-或者 64-bit寻址方式。NGIO总线改变了CPU传输数据的方式在CPU和外部设备之间不进行同步数据传输，而是将信息打成数据包在目标通道适配器和主通道适配器之间发送。这种异步通讯可将CPU从对速度较慢的外围设备数据的等待中解放出来这在多处理器系统中尤为重要，因为多处理器系统中各CPU间要为使用较慢的外围总线而展开竞争。,小结,总线分类总线特性与性能指标总线时钟，总线周期，总线带宽总线的结构总线仲裁总线通信控制时序图总线数据传输作业第66页：4、6、7、12（选）,典型的多处理器系统,