计数译码显示电路.ppt

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1、计数、译码、显示电路,一、实验目的,1、掌握集成计数器的逻辑功能及使用方法。2、掌握计数译码显示电路的一般设计方法。3、熟悉用示波器测试计数器输出波形的方法。,二、实验原理,计数、译码、显示电路是数字电路中应用很广泛的一种电路。通常，这种电路是由中规模标准模块功能电路计数器、译码器和显示电路组成。,1、计数器,计数器是一个用以实现计数功能的时序部件，主要用来累计和记忆输入脉冲的个数，它不仅可以用来对脉冲计数，还常用作数字系统的定时、分频、执行数字运算以及其他一些特定的逻辑功能。,计数器的分类,按数制分：,二进制计数器十进制计数器N 进制(任意进制)计数器,按计数方式分：,加法计数器减法计数器可

2、逆计数,按时钟控制分：,同步计数器 异步计数器,按开关元件分：,TTL 计数器CMOS 计数器,4位二进制同步加计数器,74LS161功能表,74LS161的逻辑功能,清零,使能,数据输入置数,进位,置数,ET=CTT&ETP,CO=Q3Q2Q1Q0,74LS90功能表,74LS90异步二五十 进制计数器,（2）任意进制计数器的构成,中规模集成计数器除按其自身进制实现计数功能外，还可以采用反馈法构成任意进制的计数器。假定已有的是 N 进制计数器，需要得到 M 进制计数器。M N 的情况 用一片N进制中规模集成计数器可以构成 2MN 的任意进制计数器。a）置零法（复位法）利用集成计数器的异步置零

3、端，通过反馈线强迫计数器置零。当计数器从全 0 状态 S 0 开始计数并接收了 M 个计数脉冲后，进入 S M 状态。如果将 S M 状态译码产生一个置零信号加到计数器的异步置零端，则计数器将立刻返回 S 0 状态，这样就可以跳过 N M 个状态，得到 M 进制计数器。,一、利用同步清零或置数端获得 N 进制计数,思 路：,当 M 进制计数到 SN 1 后使计数回到 S0 状态,2.求归零逻辑表达式；,1.写出状态 SN 1 的二进制代码；,3.画连线图。,步 骤：,例 用4位二进制计数器 74161 构成十二进制计数器。,解：,1.,=1011,2.归零表达式：,3.连线图,同步清零,同步置

4、零,二、利用异步清零或置数端获得 N 进制计数,当计数到 SN 时，立即产生清零或置数信号，使返回 S0 状态。（瞬间即逝）,思 路：,步 骤：,1.写出状态 SN 的二进制代码；,2.求归零逻辑表达式；,3.画连线图。,例 用二-八-十六进制异步计数器74197构成十二进制计数器。,状态S12的作用：产生归零信号,异步清零,异步置零,利用同步预置清零,利用异步清零,优点：,清零可靠,输出没有毛刺,置数法,利用集成计数器的置数端，通过给计数器重复置入某个数值的方法跳过 N M 个状态，从而得到 M 进制计数器的。反馈置数法适用于具有预置数功能的集成计数器。对于具有同步预置数功能的计数器而言，在

5、其计数过程中，可以将它输出的任何一个状态通过译码，产生一个预置数控制信号反馈至预置数控制端，在下一个CP脉冲作用后，计数器就会把预置数输入端的状态置入输出端。预置数控制信号消失后，计数器就从被置入的状态开始重新计数。还有一种方法是计数到1111状态时产生的进位信号译码后，反馈到预置数控制端实现反馈置数。,(2)M N 的情况,用多片 N 进制集成计数器组合起来才能构成 M 进制计数器。各片之间（或称为各级之间）的连接方式可分为串行进位方式、并行进位方式、整体置零方式和整体置数方式几种。若 M 可以分解为若干个因数相乘，即（N i N），则可以采用串行进位方式或并行进位方式将各个 N i 进制计

6、数器连接起来，构成 M 进制计数器。在串行进位方式中，以低位片的进位输出信号作为高位片的时钟输入信号；在并行进位方式中，以低位片的进位输出信号作为高位片的工作状态控制信号，所有芯片的 CP 输入端同时接计数输入信号。若M不可以分解为若干个因数相乘时，就必须采取整体置零方式或整体置数方式来构成 M 进制计数器。其原理与 M N 的情况类似，首先将若干片 N 进制计数器按最简单的连接方式接成一个大于 M 进制的计数器，然后在选定的某一状态下译出置零（或置数）信号，通过反馈线使所有 N 进制计数器同时置零（或置入适当的数据），跳过多余的状态，从而获得 M 进制计数器。,串行进位（异步）,优点：简单；

7、缺点：速度较慢,六十进制计数器,六十进制计数器,并行进位（同步）,优点：速度较快；缺点：较复杂,CP,1,2,3,4,5,6,7,8,9,10,QD,QC,QB,QA,0,0,0,0,0,0,1,0,0,1,0,0,0,1,0,1,1,0,1,1,0,1,0,0,1,1,0,0,1,1,0,1,0,1,0,1,十进制异步计数器波形图,0,0,0,0,0,2、显示译码器和数码管,（1）显示译码器 显示译码器将计数器的输出（BCD 代码）译成显示器（数码管）所需要的驱动信号，以便使数码管用十进制数字显示出 BCD 代码所表示的数值。根据数码管的不同，用于显示驱动的译码器也有不同的规格和品种。例如，

8、适用于共阳极数码管的译码器有 74LS46、74LS47、74LS247 等（输出低电平有效信号），适用于共阴极数码管的译码器有CC4511、74LS48、74LS49、74LS248 等（输出高电平有效信号）。,74LS48的引脚图,Top View,灯测试,灭灯,锁存,与74LS48管脚基本兼容,A3,A0,A1,A2,BCD-7段锁存、译码、驱动器CD4511）,真值表,（2）数码管,数码管是一种半导体发光器件，其基本单元是发光二极管。数码管按段数分为七段数码管和八段数码管，八段数码管比七段数码管多一个发光二极管单元（多一个小数点显示），七段数码管由七个条形发光二极管构成七段字形，七段分

9、别为 a、b、c、d、e、f、g，显示哪个字形，则相应段的发光二极管就发光。按连接方式不同，LED 数码管分为共阳极和共阴极两种。共阳极是指数码管中的七个发光二极管的阳极连在一起，接到高电平（Vcc）。当某段发光二极管的阴极为低电平时，该段就导通发光；若为高电平时就截止不发光。因此它要求与有效输出电平为低电平的七段译码器/驱动器相连。共阴极是指数码管中的七个发光二极管的阴极连在一起，接到低电平（GND）。当某段发光二极管的阳极为高电平时，该段就导通发光；若为低电平时就截止不发光。因此它要求与有效输出电平为高电平的七段译码器/驱动器相连。按能显示多少个“8”可分为1位、2位、4位等等数码管。,L

10、ED显示器的外形图,LED连接方式,计数译码显示电路,公共限流电阻,公共限流电阻,三、实验内容,1、测试74LS161的逻辑功能。输入端D3D2D1D0接逻辑开关，输出端Q3Q2Q1Q0分别接发光二极管，时钟信号CP用手动单次脉冲或1HZ的正方波信号，观察并记录各个输入端发生变化情况时的输出情况。2、用74LS161设计一个十进制计数器（P163图和图）（或自拟的小于10进制的计数器），接入译码显示电路。时钟信号用手动单次脉冲或1HZ的正方波信号，观察电路的计数、译码、显示过程。3、将1HZ的正方波信号改为1KHZ的正方波，用示波器分别观测十进制计数器Q0、Q1、Q2、Q3的输出波形以及CP的

11、波形。,注意事项,TTL集成电路工作电压为5V，因此所有电源与信号源的输出不能超过5V，注意不要把电源接错。利用示波器观察波形时，应以频率最低的一个通道作为触发信源，并正确设置触发电平,四、实验报告要求,1、画出十进制计数器、译码、显示电路中各集成芯片之间的连接图。2、用坐标纸对应时间轴，画出十进制计数器CP、Q0、Q1、Q2、Q3五个波形的波形图，标出周期，并比较它们的时序关系。3、思考题P145的1、2。,下次预习内容及要求,内容：教材P159-168，数字钟设计。设计一个具有“秒、分、时”显示计时功能的数字钟，“分、秒”按60制计时，“小时”可按24也可按12小时制计时。预习要求1、根据图5.21.8所示设计数字钟的原理框图，设计各个单元电路，然后画出完整的逻辑图。2、先用Proteus仿真软件仿真所设计的电路，仿真结果正确后，将绘制电路原理图打印。3、自拟实验方案在实验室测试所设计电路的功能。,