第一次实验.ppt
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1、,通信原理实验平台模块简介,解复用NRZ码输入,PN序列输出,信号源,同步正弦波信号输出,非同步信号输出,时钟1输出,帧同步输出,时钟2输出,NRZ码输出,NRZ码位同步,NRZ码帧同步,音乐片输出,信源编码1,PAM抽样时钟(16K),音频信号(2K同步正弦波输入),CVSD编码时钟输入(32K),音频信号(2K同步正弦波输入),译码输入端,抽样输出测试点及插孔,CVSD编码输出测试点及插孔,信号恢复输出观测点及插孔,CVSD译码时钟输入插孔,CVSD译码输出测试点及插孔,CVSD译码输入插孔,ADPCM译码信号输出插孔及测试点,ADPCM编码信号输出插孔及测试点,PCM译码位同步信号输入插
2、孔,信源编码2,A路模拟信号输入,A路PCM编码帧同步输入,A路PCM编码输出,A路PCM译码输入,A路PCM译码输出,A路PCM译码帧同步输入,主时钟2.048M,PCM编码位同步信号输入插孔,B路测试点及插孔参考A路,进行ADPCM编码信号输入孔,ADPCM译码信号输入插孔及测试点,译码信号送入耳机连接孔,话筒语音信号放大输出,话筒与耳机插座,调制电路,ASK载波输入测试点及插孔(64K),NRZ码输入测试点及插孔(8K),FSK载波输入(128K、64K),载波输入(128K),DPSK时钟输入测试点及插孔(32K),NRZ码输入测试点及插孔(8K),NRZ码输入(32K),ASK调制输
3、出测试点及插孔,FSK调制输出测试点及插孔,PSK/DPSK调制输出测试点及插孔,解调电路,ASK解调信号输入测试点及插孔,FSK解调信号输入测试点及插孔,经同步提取出来的载波输入(128K),PSK/DPSK解调信号输入测试点及插孔,ASK解调输出测试点及插孔,抽样判决后ASK解调输出测试点及插孔,FSK解调输出测试点及插孔,抽样判决后FSK解调输出测试点及插孔,PSK/DPSK解调输出测试点及插孔,抽样判决后PSK/DPSK解调输出测试点及插孔,DPSK解调位时钟测试点及插孔,Q路QPSK调制信号观测点,I路NRZ码输出测试点,QPSK调制电路,Q路NRZ码输出测试点,I路QPSK调制信号
4、观测点,QPSK调制信号合路输出观测点,NRZ码输入(16K),时钟输入(16K),QPSK解调出来的基带信号,QPSK解调信号输入测试点,I路定时判决输出,Q路定时判决输出,I路解调输出未数字化前的模拟信号,I路解调输出未数字化前的模拟信号,载波输入(512K),HDB3/AMI电平变换输出,编译码位时钟,基带传输信号输入,基带传输编码两路输出,码型变换,基带传输译码信号输出点,基带传输译码两路输入,电平变换两路信号输入,电平变换后两路信号输出,HDB3/AMI电平变换输入,载波同步,PSK调制信号输入测试点及插孔,误差电压观测点,PSK同步载波输出,PSK调制信号和0相载波相乘滤波后的波形
5、观测点,PSK调制信号和/2相载波相乘滤波后的波形观测点,压控晶振输出,滤波法位同步提取单元基带信号,基带信号经微分后波形测试点,基带信号经整流后波形测试点,波形变换后经低通滤波器输出,位同步输出观测点及插孔,锁相环法位同步提取单元基带信号输入点,位同步提取,E1帧同步信号,NRZ码帧同步输出,24分频输出,巴克码识别器输出,相位误差极性,相位误差绝对值,控制指令电平观测点,锁相环主时钟,一路PCM解复接输出信号所在时隙的帧同步,串口数据输入2,串口数据输入,PCM时分复用,串口数据输出1,主时钟(2048K),帧同步码所在0、1、2时隙的帧同步信号,一路PCM信号输入,二路PCM信号输入,二
6、路PCM信号所在时隙的帧同步信号(时隙232可选),复用信号输出,解复用位时钟,解复用帧同步,复用信号输入,解复用输出的帧同步码,一路解复用输出,二路解复用输出,二路PCM解复接输出信号所在时隙的帧同步信号,串口数据输出,方波输出插孔及测试点,锁相环,时钟/正弦信号输入(1K),锁相环输出,通过拨码开关S1、S2、S3改变分频比,通过拨码开关S4改变锁相环的振荡频率,汉明码,输入数据显示,输出数据显示,汉明码显示,误码显示,通过拨码开关插入误码,信道模拟、眼图及最佳抽样,NRZ IN:数字信号输入,BS IN:为输入信号NRZ IN的位时钟,NRZ OUT:将Filter OUT信号抽样判决后
7、恢复出的数字信号,BS OUT:NRZ OUT信号的位时钟,Filter OUT:NRZ OUT经信道传输后的信号,一、CPLD可编程数字信号发生器,一、实验目的二、实验内容三、实验仪器四、实验原理五、实验框图六、实验步骤七、实验结果,一、CPLD可编程数字信号发生器,一、实验目的,1、熟悉各种时钟信号的特点及波形;2、熟悉各种数字信号的特点及波形。,二、实验内容,1、熟悉CPLD可编程信号发生器各测量点波形;2、测量并分析各测量点波形及数据;3、学习 CPLD可编程器件的编程操作。,一、CPLD可编程数字信号发生器,1、信号源模块 一块2、连接线 若干3、20M 双踪示波器 一台,三、实验仪
8、器,一、CPLD可编程数字信号发生器,CPLD可编程模块用来产生实验系统所需要的各种时钟信号和各种数字信号。它由CPLD可编程器件ALTERA公司的EPM240T100C5、下载接口电路和一块晶振组成。晶振JZ1用来产生系统内的32.768MHz主时钟。本实验要求参加实验者了解这些信号的产生方法、工作原理以及测量方法,才可通过CPLD可编程器件的二次开发生成这些信号,理论联系实验,提高实际操作能力。1、CPLD数字信号发生器,包括以下五个部分:时钟信号产生电路;伪随机码产生电路;帧同步信号产生电路;NRZ码复用电路及码选信号产生电路;终端接收解复用电路。,四、实验原理,一、CPLD可编程数字信
9、号发生器,2、24位NRZ码产生电路 本单元产生NRZ信号,信号速率可根据输入时钟不同自行选择,帧结构如下图所示。帧长为24位,其中首位无定义,第2位到第8位是帧同步码(7位巴克码1110010),另外16路为2路数据信号,每路8位。此NRZ信号为集中插入帧同步码时分复用信号。LED亮状态表示1码,熄状态表示0码。,四、实验原理,一、CPLD可编程数字信号发生器,五、实验框图,一、CPLD可编程数字信号发生器,CPLD数字信号产生,时钟信号,伪随机码,帧同步信号,NRZ码产生,复用与解复用电路,六、实验步骤,一、CPLD可编程数字信号发生器,1、将信号源模块固定在主机箱上,将黑色塑封螺钉拧紧,
10、确保电源接触良好,打开电源;2、观测时钟信号输出波形。信号源输出两组时钟信号,对应输出点为“CLK1”和“CLK2”,拨码开关S4的作用是改变第一组时钟“CLK1”的输出频率,拨码开关S5的作用是改变第二组时钟“CLK2”的输出频率。拨码开关拨上为1,拨下为0。查看信号源模块点击(1)根据码型与频率对照表改变S4,用示波器观测第一组时钟信号“CLK1”的输出波形;(2)根据码型与频率对照表改变S5,用示波器观测第二组时钟信号“CLK2”的输出波形;查看码型与频率对照表点击,六、实验步骤,一、CPLD可编程数字信号发生器,3、用示波器观测帧同步信号输出波形 信号源提供脉冲编码调制的帧同步信号,在
11、点“FS”输出,一般时钟设置为2.048M、256K,在后面实验中有用到。将拨码开关S4分别设置为“0100”、“0111”,用示波器观测“FS”的输出波形。4、用示波器观测伪随机信号输出波形 伪随机信号码型为111100010011010,码速率和第一组时钟速率相同,由S4控制。根据码型与频率对照表改变S4,用示波器观测“PN”的输出波形。,六、实验步骤,一、CPLD可编程数字信号发生器,5、观测NRZ码输出波形 信号源提供24位NRZ码,码型由拨码开关S1,S2,S3控制,码速率和第二组时钟速率相同,由S5控制。(1)将拨码开关S1,S2,S3设置为01110010 11001100 10
12、101010,S5设为1010,用示波器观测“NRZ”输出波形;(2)保持码型不变,改变码速率(改变S5),用示波器观测“NRZ”输出波形;(3)保持码速率不变,改变码型(改变S1、S2、S3),用示波器观测“NRZ”输出波形。查看数字信号源输出波形点击6、实验结束关闭电源,整理数据完成实验报告。,一、CPLD可编程数字信号发生器,二、模拟信号源实验,图2-1 同步正弦波产生电路,二、模拟信号源实验,图2-2 非同步信号源产生电路,二、模拟信号源实验,图2-3 音乐信号产生电路,二、模拟信号源实验,图2-4 64K载波产生电路,二、模拟信号源实验,图2-5 128K载波产生电路,一、实验目的二



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