数字电路与系统设计(实验八)同步时序电路逻辑设计.doc
《数字电路与系统设计(实验八)同步时序电路逻辑设计.doc》由会员分享,可在线阅读,更多相关《数字电路与系统设计(实验八)同步时序电路逻辑设计.doc(6页珍藏版)》请在三一办公上搜索。
1、实验八 同步时序电路逻辑设计一、实验目的:1掌握同步时序电路逻辑设计过程。2掌握实验测试所设计电路的逻辑功能。3学习EDA软件的使用。二、实验仪器:序号仪器或器件名称型号或规格数量1逻辑实验箱12万用表13双踪示波器1474LS1941574LS1121674LS041774LS001874LS861974LS101三、实验原理:设计要求状态转移图状态转移表状态化简状态分配选择触发器激励方程、输出方程逻辑电路同步时序电路逻辑设计过程方框图如图8-1所示。 图8-1其主要步骤有:1确定状态转移图或状态转移表根据设计要求写出状态说明,列出状态转移图或状态转移表,这是整个逻辑设计中最困难的一步,设计
2、者必须对所需要解决的问题有较深入的理解,并且掌握一定的设计经验和技巧,才能描绘出一个完整的、较简单的状态转移图或状态转移表。2状态化简将原始状态转移图或原始状态转移表中的多余状态消去,以得到最简状态转移图或状态转移表,这样所需的元器件也最少。3状态分配这是用二进制码对状态进行编码的过程,状态数确定以后,电路的记忆元件数目也确定了,但是状态分配方式不同也会影响电路的复杂程度。状态分配是否合理需经过实践检验,因此往往需要用不同的编码进行尝试,以确定最合理的方案。4选择触发器通常可以根据实验室所提供的触发器类型,选定一种触发器来进行设计,因为同步时序电路触发器状态更新与时钟脉冲同步,所以在设计时应尽
3、量采用同一类型的触发器。选定触发器后,则可根据状态转移真值表和触发器的真值表作出触发器的控制输入函数的卡诺图,然后求得各触发器的控制输入方程和电路的输出方程。5排除孤立状态理论上完成电路的设计后,还需检查电路有否未指定状态,若有未指定状态,则必须检查未指定状态是否有孤立状态,即无循环状态,如果未指定状态中有孤立状态存在,应采取措施排除,以保证电路具有自启动性能。经过上述设计过程,画出电路图,最后还必须用实验方法对电路的逻辑功能进行验证,如有问题,再作必要的修改。时序电路的功能测试可以用静态和动态两种方法进行,静态测试由逻辑开关或数据开关提供输入信号,测试各级输出状态随输入信号变化的情况,可用指
- 配套讲稿:
如PPT文件的首页显示word图标,表示该PPT已包含配套word讲稿。双击word图标可打开word文档。
- 特殊限制:
部分文档作品中含有的国旗、国徽等图片,仅作为作品整体效果示例展示,禁止商用。设计者仅对作品中独创性部分享有著作权。
- 关 键 词:
- 数字电路 系统 设计 实验 同步 时序电路 逻辑设计
链接地址:https://www.31ppt.com/p-4192452.html