整点报时器——模电课程设计说明书.doc
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1、信息与电气工程学院课程设计说明书(200 9 /2010 学年第 二 学期)课程名称 : 电子技术课程设计 题 目 : 整点报时数字钟电路设计 专业班级 : 电气0801 学生姓名 : 王贝贝 学 号: 080060104 指导教师 : 崔春艳 设计周数 : 2周 设计成绩 : 2010年 7月9日1课程设计目的及设计要求12系统的方案设计13 系统的详细设计13.1脉冲产生和分频电路13.1.1脉冲产生和分频电路的设计13.1.2关键器件CD4060的介绍13.2计时电路13.2.1分,秒计时电路的设计13.2.2小时计时电路的设计13.2.3关键器件CD4510的介绍13.3显示译码电路1
2、3.3.1显示译码电路的设计13.3.2关键器件CD4511和数码管的介绍13.4校时电路13.4.1校时的电路的详细设计13.4.2关键器件RS触发器的详细介绍13.5整点报警电路24设计过程说明25 心得体会26 参考文献21课程设计目的及要求设计目的数字钟是一种用数字电路技术实现时、分、秒计时的装置,与机械式时钟相比具有更高的准确性和直观性,且无机械装置,具有更长的使用寿命,因此得到了广泛的使用。数字钟 ,从原理上讲是一种典型的数字电路,其中包括了组合逻辑电路和时序电路。因此,设计与制作数字钟就是为了了解数字钟的原理,从而学会制作数字钟,而且可以通过数字钟的制作进一步了解在制作中用到的各
3、种中小规模集成电路的作用及使用方法。再者,由于数字钟包括组合逻辑电路和时序电路,通过它可以进一步学习与掌握各种组合逻辑电路与时序电路的原理与使用方法设计要求设计指标 (1)时间以24小时为一个周期;(2)显示时、分、秒;(3)有校时功能,可以分别对时及分进行单独校时,使其校正到标准时间;(4)保证计时的稳定及准确须由晶体振荡器提供表针时间基准信号。设计要求(1)画出电路原理图和PCB图;(2)自行装配和调试,并能发现问题和解决问题;(3)编写设计报告,写出设计与制作的全过程,附上有关资料和图纸及心得体会。2系统的方案设计本实验设计的数字钟具有基本功能和扩展功能两部分。其中,基本功能由振荡器、分
4、频器、计数器和译码显示器构成,可以实现准确计时,并以数字形式显示时、分、秒的时间。扩展功能则具有校时和整点报时两个功能。根据设计要求首先建立了一个数字钟电路系统的组成框图,如图1所示。图1由图1可知,电路的工作原理是:振荡器产生的高秒冲信号作为数字钟的振源,在经分频器输出标准秒脉冲。秒计数器计满60后向分计数器个位进位,分计数器计满60后向小时计数器个位进位并且小时计数器以24小时为一个周期。计数器的输出经译码器由数码管显示。当计时出现差错时,校时电路进行校时、校分、校秒,使其校正到标准时间。计时过程中具有报时功能,当时间到达整点前10秒(即59分50秒)时进行蜂鸣报时。3系统的详细设计下面将
5、对各部分电路进行详细设计3.1脉冲产生和分频电路3.1.1脉冲产生和分频电路的设计(1)数字钟的构成数字钟实际上是一个对标准频率(1HZ)进行计数的计数电路。由于计数的起始时间不可能与标准时间(如北京时间)一致,故需要在电路上加一个校时电路,同时标准的1HZ时间信号必须做到准确稳定。通常使用石英晶体振荡器电路构成数字钟。(2)晶体振荡器电路晶体振荡器电路给数字钟提供一个频率稳定准确的32768z的方波信号,可保证数字钟的走时准确及稳定。不管是指针式的电子钟还是数字显示的电子钟都使用了晶体振荡器电路。一般输出为方波的数字式晶体振荡器电路通常有两类,一类是用门电路构成;另一类是通过非门构成的电路,
6、本次设计采用了后一种。由非门与晶体、电容和电阻构成晶体振荡器电路,实现整形功能,将振荡器输出的近似于正弦波的波形转换为较理想的方波。输出反馈电阻为非门提供偏置,使电路工作于放大区域,即非门的功能近似于一个高增益的反相放大器。电容、与晶体构成一个谐振型网络,完成对振荡频率的控制功能,同时提供了一个度相移,从而和非门构成一个正反馈网络,实现了振荡器的功能。由于晶体具有较高的频率稳定性及准确性,从而保证了输出频率的稳定和准确。(3)分频器电路 通常,数字钟的晶体振荡器的输出频率较高,为了得到1HZ的秒信号输入,需要对振荡器的输出信号进行分频。通常实现分频器的电路是计数器电路,一般采用多级2进制计数器
7、来实现。实际上,从尽量减少元器件的数量的角度来考虑,可选用CD4060和CD4040来构成分频电路。而且CD4060还包含振荡电路所需的非门,使用起来更为方便,所以这里采用CD4060元器件实现该分频功能。由于32768为2的15级进制,而CD4060只能实现2的14次分频,故还需要一个异位二进制计数器(为74LS74)实现二分频功能,这样便将32768HZ的振荡信号分频为所需的1HZ的秒脉冲输入信号。图2.晶振-分频电路 3.1.2关键器件CD4060的介绍CD4060-14 位二进制串行计数器简要说明:CD4060 由一震荡器和14 极二进制串行计数器位组成,震荡器的结构可以是RC 或晶振
8、电路。CR 为高电平时,计数器清零且振荡器使用无效,所有的计数器位均为主从触发器。在CP1(和CP0)的下降沿计数器以二进制进行计数,在时钟脉冲线上使用施密特触发器对时钟上升和下降时间无限制。CD4060 提供了16 引线多层陶瓷双列直插(D)、熔封陶瓷双列直插(J)、塑料双列直插(P)和陶瓷片状载体(C)4 种封装形式。引出端符号CP1 时钟输入端CP0 时钟输出端CP0 反相时钟输出端Q4Q10,Q12Q14 计数器输出端Q14 第 14级计数器反相输出端VDD 正电源Vss 地逻辑符号:CD4060引脚图:引出端排列(俯视) CD4060内部结构图:功能表:逻辑图:CD4060秒脉冲发生
9、器电路脉冲发生器是数字钟的核心部分,它的精度和稳定度决定了数字钟的质量,通常用晶体振荡器发出的脉冲经过整形、分频获得1Hz的秒脉冲。如晶振为32768 Hz,通过15次二分频后可获得1Hz的脉冲输出,电路图如图3所示。图33.2计时电路时间计数电路有时计数、分计数、秒计数几部分构成。其中由1个二十四进制电路、2个六十进制电路组成秒个位和秒十位计数器、分个位和分十位计数器为60进制计数器,而小时计数为24进制计数器,其输出均为两位8421BCD码形式。一般采用10进制计数器CD4510通过反馈法来构成各进制计数器以便实现各时间计数单元的计数功能,并且每一计数器均有一个异步清零端和置数端(高电平有
10、效)。下面将分别介绍各部分计数器的使用。 3.2.1分,秒计时电路的设计秒个位计数单元为进制计数器,无需进制转换,在正常加计数工作状态下,只需将进位输入信号端CI、反馈清零端CR、反馈置数端LD接地,数据输入端D0、D1、D2、D3接地,U/D端接电源,而进位信号输出端CO可作下一个的信号输入与秒十位的CK端相连。秒十位计数单元为进制计数器,需要进制转换。将进制计数器转换为进制计数器的电路连接方法采用反馈清零法,将Q2、Q4通过与门相连作为反馈清零信号连到CR端,其中CO端可作为向上的进位信号与分个位的计数单元的K相连。分个位和分十位计数单元电路结构分别与秒个位和秒十位计数单元完全相同,只不过
11、分个位计数单元的CO端作为向上的进位信号应与分十位计数单元的k相连,分十位计数单元的CO作为向上的进位信号应与时个位计数单元的K相连。3.2.2小时计时电路的设计时个位计数单元电路结构仍与秒(或分)个位计数单元相同,但是要求,整个时计数单元应为24进制计数器,而不是的整数倍,因此需将个位和十位计数单元合并为一个整体才能进行24进制转换,再利用片与门74LS08实现24进制计数的功能。3.2.3关键器件CD4510的介绍十进制同步加/减计数器 CD4510简要说明CD4510 为可预置BCD 可逆计数器,该器件主要由四位具有同步时钟的D 型触发器(具有选通结构,提供T 型触发器功能)构成。具有可
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