2673693929第2章微型计算机和微处理器的结构.ppt

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1、微型计算机原理,-8086/8088微型计算机和微处理器结构,第2章 微型计算机和微处理器功能结构(4h),2.1 微型计算机的组成及工作原理2.2 8086/8088微处理器的功能结构2.3 80286微处理器的功能结构2.4 80386/80486 CPU的功能结构2.5 Pentium级CPU的功能结构,备注：主要讲 8086/8088微型计算机和微处理器结构，80286/80386/80486不讲,微型计算机系统的构成,显示器(输出设备),主机箱,鼠标(输入设备),键盘(输入设备),电源,光驱,硬盘,内存,CPU,主板,扩展卡,微型计算机系统的构成主机箱,典型的微型计算机硬件组成示于图

2、2.1，它由下列几种大规模集成电路通过总线连接而成。,图2.1 微型计算机的硬件组成,2.1 微型计算机的组成及工作原理,微型计算机包括：微处理器CPU；一定容量的内部存储器（包括ROM、RAM）；输入/输出接口电路组成；各功能部件之间通过总线有机地连接在一起。其中：微处理器是整个微型计算机的核心部件。内部存贮器按照读写方式的不同分为ROM和RAM；输入/输出接口电路是外围设备与微型计算机之间的连接电路，在两者之间进行信息交换的过程中，起 暂存、缓冲、类型变换及时序匹配的作用；总线是CPU与其它各功能部件之间进行信息传输的通道，按所传送信息的不同类型，总线可以分为数据总线DB、地址总线AB 和

3、 控制总线CB三种类型。,2.1.1 微处理器（微处理机）微处理器：是微型计算机的中央处理部件，是由一片或几片大规模集成电路组成的中央处理器，一般也称CPU（Center Process Unit）。其内部通常包括算术逻辑部件，累加器、通用寄存器组，程序计数器，时序和控制逻辑部件，内部总线等等。,2.1.2 存储器 存储器是指微型计算机的内存储器。它通常由CPU 之外的半导体存储器芯片组成，用来存放程序、原始操作数、运算的中间结果数据和最终结果数据。包括RAM(Random Access Memory)和ROM(Read Only Memory)。,2.1.3 输入/输出设备及其接口电路输入/

4、输出设备输入/输出(Input/Output，I/O)设备统称为外部设备，简称I/O设备，是微型计算机的重要组成部分。输入/输出设备的任务是将程序、原始数据及现场信息以计算机所能识别的形式送到计算机，经过计算机自动计算或处理并将其结果或回答信号以人能识别的形式表示出来。常用的输入设备包括键盘、鼠标器、数字化仪、扫描仪、A/D转换器、只读激光盘(CD-ROM）及其驱动器等；输出设备的任务是将微型机中常用的输出设备包括显示器、打印机、绘图仪、D/A转换器等。,I/O接口电路(I/O Interface)接口电路的作用：CPU只能处理数字量，而外部设备处理的有数字量、模拟量等。因而，外部设备(简称外

5、设)与CPU间的硬件连线和信息交换不能直接进行，必须经过接口电路进行协调和转换。接口电路的主要职责是将微处理器和输入/输出设备之间的信息统一起来。常用的I/O接口电路有：8255A可编程并行接口电路、8253可编程定时/计数电路、8251可编程串行接口电路、8237直接存储器存取电路(DMA)等。,2.1.4 总线 总线是连接多个功能部件或多个装置的一组公共信号线。按在系统中的不同位置，总线可以分为内部总线和外部总线。内部总线是CPU内部各功能部件和寄存器之间的连线；外部总线是连接系统的总线，即连接CPU、存储器和I/O接口的总线，又称为系统总线。按所传送信息的不同类型，总线可以分为：数据总线

6、DB(Data Bus)、地址总线AB(Address Bus)控制总线CB(Control Bus)通常称微型计算机采用三总线结构。,地址总线(Address Bus)地址总线是微型计算机用来传送地址信息的信号线。地址总线的位数决定了CPU可以直接寻址的内存空间的大小。因为地址总是从CPU发出的，所以地址总线是单向的、三态总线。单向指信息只能沿一个方向传送；三态指除了输出高、低电平状态外和高阻抗状态（浮空状态）。数据总线(Data Bus)数据总线是CPU用来传送数据信息的信号线（双向、三态）。数据总线是双向三态总线，即数据既可以从CPU送到其它部件，也可以从其它部件传送给CPU，数据总线的

7、位数和处理器的位数相对应。,控制总线(Control Bus)控制总线是用来传送控制信号的一组总线。这组信号线比较复杂，由它来实现CPU对外部功能部件（包括存储器和I/O接口）的控制及接收外部传送给CPU的状态信号，不同的微处理器采用不同的控制信号。控制总线的信号线有：单向、双向、三态、非三态等，取决于具体的信号线。,8086/8088微处理器是Intel公司推出的第三代CPU芯片，它们的内部结构基本相同，都采用16位结构进行操作及存储器寻址，但外部性能有所差异，两种处理器均采用DIP(40脚双列直插)封装。,2.2 8086/8088微处理器的功能结构,8086/8088以及80186、80

8、286微处理器均属Intel公司生产的第三代16位微处理器。它们与第二代8位微处理器的区别不仅是数据总线的位数增加了1倍，更重要的是采取了流水线处理技术。具体来说，是将指令执行部件EU（Execution Unit）和总线接口部件BIU（Bus Interface Unit）分为两个独立的部分，可并行操作。图2.2示出串行处理和流水处理的情况。一个简单的微处理器，如8位微处理器，它们在执行一条指令时，指令取出、指令译码、数据取出、指令执行和结果存储是串行进行的，见图2.2(a)。（P40）,2.2.1 流水处理,时间,（a）串行处理,BIU,EU,（b）流水处理,图2.2 串行处理和流水处理,

9、如图：8086/8088 CPU 由于指令执行部件EU和总线接口部件BIU相互独立，可并行操作，进行流水线处理。若一条指令执行过程中不需要从存储器取操作数和向存储器存储结果，即不占CPU总线时间，总线接口部件便可对下一条要执行的指令预取。可见。采用流水线技术提高了指令执行速度。,BIU,EU,（b）流水处理,Intel公司同期推出的Intel8088微处理器，其内部寄存器，内部操作等均按16位处理器设计，与Intel 8086微处理器基本上相同，而外部数据为8位，故称为准16位微处理器。8086为典型的16位CPU：16位的内部数据总线，16位外部数据总线；8088为准16位CPU：16位的内

10、部数据总线，8位外部数据总线;20 位地址信号线，可寻址1M字节存储单元；利用低16位的地址总线来进行I/O端口寻址，可寻址64K 个I/O端口；较强的指令系统；中断功能强，可处理内部软件中断和外部中断，中断源可达256个；单一的5V电源，单相时钟 5MHz。,2.2.2 8086/8088微处理器的一般性能特点：,图2.3 8086/8088CPU内部功能结构图,2.2.3 8086/8088微处理器的功能结构,从功能上来看，8086/8088 CPU可分为两部分，即总线接口部件BIU（Bus Interface Unit）和执行部件EU（Execution Unit）。,(1)执行部件（E

11、U）功能：负责指令的执行。(主要进行8位及16位的各种运算)组成：ALU(算术逻辑单元)；通用寄存器组；标志寄存器（FLAGS）。通用寄存器（AX、BX、CX、DX）8086 有4个16位的通用寄存器（AX、BX、CX、DX），可以存放16位的操作数，也可分为8个8位的寄存器（AL、AH；BL、BH；CL、CH；DL、DH）来使用。其中AX称为累加器，BX称为基址寄存器，CX称为计数寄存器，DX称为数据寄存器。这些寄存器在具体使用上有一定的差别，如表2-1所示。,表2-1 内部寄存器主要用途,指针寄存器（SP和BP）SP和BP位两个16位的指针寄存器。SP是堆栈指针寄存器，用来存放现行堆栈段的

12、段内偏移地址，并具有步进增量和减量的功能。由它和堆栈段寄存器SS一起来确定堆栈在内存中的位置；BP是基数指针寄存器，通常用于存放基地址。当程序执行：调用子程序或响应中断时的主程序时，要保证程序执行完后正确的返回主程序，则需要保存断点地址以及其他寄存器的内容。,例如，进行子程序嵌套(见图2.5)时，不仅需要把许多信息(包括断点地址和寄存器内容等)逐一存入堆栈并保留下来，还必须能把堆栈所保留的信息逐一正确地取出来并返回原处。,图2.5 子程序的嵌套,堆栈是一组寄存器或一个存储区域，用来存放调用子程序或响应中断时的主程序断点地址及其他寄存器的内容。堆栈组成的方法有两种：硬件堆栈和软件堆栈。微处理器内

13、一组由寄存器构成的堆栈称为硬件堆栈。它的优点是访问的速度快；缺点是寄存器的数量即堆栈的深度有限。在存储器中开辟一个区域构成的堆栈称为软件堆栈。它的优点是堆栈的深度几乎没有限制；缺点是访问堆栈的速度较慢。80X86系列微处理器均采用软件堆栈。下面以8086微处理器为例，简单叙述堆栈的工作原理。,当将信息存入堆栈或从堆栈中取出信息时，都必须严格的按照“后进先出”规则进行。在8086中，堆栈被定义为由SS：SP寄存器对指出的存储区域。堆栈段的起始地址由SS段寄存器内容左移4位形成。堆栈段内的偏移地址由SP寄存器指出。如图2.6（a）为8086堆栈的逻辑地址。,图2.6（a）8086堆栈的逻辑地址,S

14、P,SS,由于SP为16位，在8086中堆栈的最大容量为64KB。图2.6（b）示出堆栈的形式和术语，其中栈底为初始堆栈指针值(即SP初值)。当前栈顶即为当前SP值，它指向最后压入字的两个单元。,图2.6 8086堆栈形式,向下生成,SS：SP,高地址,低地址,堆栈操作有两种：一种叫压入(PUSH)，另一种叫弹出(POP)。对8086/8088 CPU来说，每次压入或弹出一个字，最后压入堆栈的字总是最先弹出来，堆栈的这种后进先出的特点是由堆栈指示器SP来控制的。SP必须具有自动步进增量和减量的功能。在向下生成方式中，栈底占用较高地址，栈顶占用较低地址。当需要把一个字压入(PUSH)堆栈时，首先

15、SP自动减2，指向新的栈顶两个空单元，然后将要压入堆栈的一个字送入栈顶两个单元中。当要将堆栈中栈顶两个单元的一个字弹出(POP)堆栈时，先将SP所指栈顶两个单元的内容弹出，然后再将SP加2指向新的栈顶。,xx,xx,54xx,36,高地址(栈底),低地址(栈顶）,SP,SP,SP,向下生成,80X86 CPU中堆栈采用向下生成的方式。与向下生成方式相对应，还有向上生成的堆栈编址方式，即栈底占用较低地址，栈顶占用较高地址。由于堆栈指示器的设置，在某种特定情况下，它就能自动跟踪栈顶地址，而不需要在编程中考虑这种跟踪。例如，在执行调用指令时，能自动把断点地址压入SP所指的栈区存储单元。而执行返回指令

16、时，又能自动按SP所指的栈存储单元将断点地址从栈区弹出，送到指令指针IP中去。通常堆栈操作从不移动和擦除栈区存储单元内容，堆栈操作时仅是修改堆栈指针。但压入堆栈操作时，则是用新压入的数据取代栈区原存储单元内容。,变址寄存器（SI和DI）系统中有两个16位的变址寄存器SI和DI。SI是源变址寄存器，DI是目的变址寄存器，都用于指令的变址寻址方式。控制寄存器IP、FLAGS是系统中的两个16位控制寄存器。,图2-2 标志寄存器,FLAGS 标志寄存器,其内容被称为处理器状态字PSW，用来存放8086 CPU在工作过程中的状态，可分成两类：一类为状态标志，一类为控制标志。,CF(Carry FIag

17、)-进位标志位，做加法时最高位出现进位或做减法时最高位出现借位，该位置1，反之为0。PF(Parity FIag)奇偶标志位，当运算结果的低8位中l的个数为偶数时，则该位置1，反之为0。AF(Auxiliary Carry Flag)半进位标志位，做字节加法时，当低四位有向高四位的进位，或在做减法时，低四位有向高四位的借位时，该标志位就置1。通常用于对BCD算术运算结果的调整。,AF1，CF1,例：,(1)状态标志,ZF(Zero Flag)零标志位，运算结果为0时，该标志位置1，否则清0。SF(Sign Flag)符号标志位，当运算结果的最高位为1，该标志位置1，否则清0。即与运算结果的最高

18、位相同。OF(Overflow Flag)溢出标志位。OF溢出的判断方法如下：,带符号数的溢出判别采用1.2节中所叙述的双高位判别法。,双高位判别法。当CsCp=1时，产生溢出；Cs Cp=0时，不产生溢出其中：Cs表示符号位的进位，Cp表示数值部分最高位的进位)。若要判断两个带符号数a与b的大小(a-b)，必须采用如下规则进行判断：OF SF=1，表示ab；OF SF=0，表示ab。,CF0、AF1、PF1、ZF0、SF1、OF CsCp=1（两正数相加结果为负)。微处理器选择这一组状态标志，可以只用一套指令便可方便地对无符号数、带符号数及BCD数进行运算，并判断其溢出情况和比较两数大小。,

19、例：,(2)控制标志：3个TF(Trap Flag)陷阱标志位(单步标志位、跟踪标志)。当该位置1时，将使8086/8088进入单步工作方式，通常用于程序的调试。当TF=1时，如果执行指令，则产生单步中断，即CPU每执行一条指令便自动产生一个内部中断，使CPU 转去执行一个中断服务子程序。IF(Interrupt-Enable Flag)中断允许标志位，若IF=1，则处理器可以响应可屏蔽中断，否则就不能响应可屏蔽中断。DF(Directon Flag)方向标志位，用于指定字符串处理命令的步进方向。若该位置1，则串操作指令的地址修改为自动减量方向，反之，为自动增量方向。,组成：段寄存器（DS、C

20、S、ES、SS）；16位指令指针寄存器IP（指向下一条要取出的指令代码）；20位地址加法器（用来产生20位地址）6字节（8088为4字节）指令队列缓冲器组成。,功能：负责与存储器及I/O接口之间的数据传送操作。具体来看，完成取指令送指令队列，配合执行部件的动作，从内存单元或I/O端口取操作数，或者将操作结果送内存单元或者I/O端口。,(2)总线接口部件（BIU）,段寄存器（DS、CS、ES、SS）；(1)CS：存放当前代码段的基地址，要执行的指令代码在当前代码段中。(2)DS：存放当前数据段的基地址，指令中所需操作数常存放于当前数据段中。(3)SS：存放当前堆栈段的基地址，堆栈操作所处理的数据

21、均存放在当前堆栈段中。(4)ES：存放当前附加段的基地址，附加段通常也用来存放存储器操作数。,IP：指令指针寄存器，用来控制CPU的指令执行顺序，总是存放着下一条要取出指令在现行代码段内的偏移地址。IP和代码段寄存器CS一起可以确定当前所要取的指令的内存地址。,IP的工作方式：顺序执行程序时，CPU每取一个指令字节，IP自动加1，指向下一个要读取的字节；当IP单独改变时，会发生段内的程序转移；当CS和IP同时改变时，会产生段间的程序转移。,8086的指令队列分别为6/4个字节，在执行指令的同时，可从内存中取出后续的指令代码，放在指令队列中，可以提高CPU的工作效率。地址加法器用来产生20位物理

22、地址。8086可用20位地址寻址1M字节的内存空间，而CPU内部的寄存器都是16 位，因此需要由一个附加的机构来计算出20位的物理地址，这个机构就是20位的地址加法器。,AH AL BH BL CH CL DH DL,AX BX CX DX,SP BP SI DI,IP FLAG,CS DS SS ES,(A)累加器 基地址寄存器 计数器 数据寄存器,(SP)堆栈指针寄存器 基地址寄存器 源变址寄存器 目的变址寄存器,(PC)指令指针寄存器(PSW)状态标志寄存器,代码段寄存器 数据段寄存器 堆栈段寄存器 附加段寄存器,通用寄存器,控制寄存器,段寄存器,8位寄存器,16位寄存器,(3)BIU与

23、EU的动作协调原则(p41)BIU和EU按以下流水线技术原则协调工作，共同完成所要求的信息处理任务：每当8086/8088的指令队列中有两个(一个)空字节，同时EU 也未要求BIU进入存取操作数的总线周期，BIU就会自动把指令取到指令队列中。其取指的顺序是按指令在程序中出现的前后顺序。,每当EU准备执行一条指令时，它会从BIU部件的指令队列前部取出指令的代码，然后用几个时钟周期去执行指令。在执行指令的过程中，如果必须访问存储器或者I/O端口，那么EU就会请求BIU，进入总线周期，完成访问内存或者I/O端口的操作；如果此时BIU正好处于空闲状态，会立即响应EU的总线请求。如BIU正将某个指令字节

24、取到指令队列中，EU等待BIU将首先完成这个取指令的总线周期，然后再去响应EU发出的访问总线的请求。当指令队列已满，且EU又没有总线访问请求时，BIU便进入空闲状态。,在执行转移指令、调用指令和返回指令时，由于待执行指令的顺序发生了变化，则指令队列中已经装入的字节被自动消除，BIU会接着往指令队列装入转向的另一程序段中的指令代码。BIU与EU的动作管理原则中，既相互独立又相互配合的关系，使得8086/8088可以在执行指令的同时，进行取指令代码的操作，也就是说BIU与EU是一种并行工作方式，改变了以往计算机取指令译码执行指令的串行工作方式，大大提高了工作效率，这正是8086获得成功的原因之一。

25、,2.2.4 8086/8088的存储器分段结构及物理地址形成,1.存储容量 8086有20根地址总线，因此，可直接寻址的存储器单元数为220=1Mbyte=1M B2.物理地址 8086可直接寻址1Mbyte的存储空间，其地址区域为00000H0FFFFFH，与存储单元一一对应的20位地址称之为存储单元的物理地址。,3.存储器的分段及段地址 由于CPU内部的寄存器都是16位的，为了能够提供20位的物理地址，系统中采用了存储器分段的方法。规定：在1MB的存储空间中，系统的整个存储空间可分为16个互不重叠的逻辑段，存储器的一个段为64KB，由段寄存器来确定存储单元的段地址。如图2-3所示；也可以

26、有216个段地址，任意相邻的两个段地址最少只相距16个存储单元，存储器的每个段的容量为64KB，并允许在整个存储空间内浮动，即段与段之间可以部分重叠、完全重叠、连续排列，非常灵活，如图2-4所示。,图2-3 存储空间段结构 图2-4 分段逻辑结构,16存储单元,图2.10 分段的实例(图中堆栈段和数据段在此例中是重叠的，这用在存储共享的情况下),5.物理地址的形成 物理地址是由段地址与偏移地址共同决定的，段地址是16位地址，由段地址及偏移地址计算物理地址的表达式如下：物理地址=段地址10H+偏移地址段地址：代码段寄存器(Code Segment，CS)、堆栈段寄存器(Stack Segment

27、，SS)、数据段寄存器(Data Segment，DS)和附加段寄存器(Extra Segment，ES)。,4.偏移地址 偏移地址是某存储单元相对其所在段起始位置的偏移字节数，或简称偏移量。它是一个16位的地址，根据指令的不同，它可以来自于CPU中不同的16位寄存器（IP、SP、BP、SI、DI、BX等）。,图2.9 20位物理地址的构成及寻址举例,例：CS0FE00H，IP0400H，则表示要取指令代码的物理地址为0FE400H。若C018：FE7F表示段地址为C018H，偏移地址为FE7FH。则物理地址为CFFFFH。如图2.9所示。系统启动后，指令的物理地址由CS的内容与IP的内容共同

28、决定，由于系统启动的CS=0FFFFH，IP=0000H，所以初始指令的物理地址为0FFFF0H。我们可以在0FFFF0H单元开始的几个单元中，固化一条无条件转移指令的代码，即转移到系统初始化程序部分。,6.存储器分段组织带来存储器管理的新特点：首先，在程序代码量、数据量不是太大的情况下，可使它们处于同一段内，即使它们在64Kbyte的范围内，这样可以减少指令的长度，提高指令运行的速度；其次，内存分段为程序的浮动分配创造了条件；第三，物理地址与形式地址并不是一一对应的。举例：由形式地址 6832H：1280H可以唯一确定物理地址为695A0H。反之，物理地址为695A0H，则其形式地址可以为：

29、6832H：1280H，也可以为：6830H：12A0H。第四，各个分段之间可以重叠。,7.特殊的内存区域 8088/8086系统中，有些内存区域的作用是固定的，用户不能随便使用，如：中断矢量区：00000H003FFH共1K字节，用以存放256种中断类型的中断矢量，每个中断矢量占用4个字节，共2564=1024=1K显示缓冲区：B0000HB0F9FH约4000（25802）字节，是单色显示器的显示缓冲区，存放文本方式下，所显示字符的ASCII码及属性码；B8000HBBF3FH约16K字节，是彩色显示器的显示缓冲区，存放图形方式下，屏幕显示象素的代码。启动区：FFFF0HFFFFFH共16

30、个单元，用以存放一条无条件转移指令的代码，转移到系统的初始化部分。,3.内部存贮器按照读写方式的不同分为？,单向的总线：，双向的总线：。,地址总线,数据总线和控制总线,4.8086/8088与第二代8位微处理器的区别不仅是数据总线的位数增加了1倍，更重要的是采取了 技术,流水线处理,微处理器、内部存贮器、输入/输出接口电路 和 总线。,2.总线按所传送信息的不同类型可以分为？,数据总线DB、地址总线AB和控制总线CB三种类型。,1.微型计算机包括？,RAM(Random Access Memory)和ROM(Read Only Memory)。,5.8086/8088 CPU 可分为两部分？,

31、组成：ALU(算术逻辑单元)；通用寄存器组；标志寄存器（PSW）。,执行部件EU,总线接口部件BIU,6.执行部件EU,SP和BP位两个16位的指针寄存器。SP是存放现行堆栈段的段内偏移地址，并具有步进增量和减量的功能。堆栈段寄存器SS；,7.指针寄存器（SP和BP）,堆栈存取数据的原则：,先进后出,向下生成堆栈区：PUSH,SP减量修正,POP,SP增量修正,【例如】MOV AX,5436H;(AX)=5436H PUSH AX POP BX,;(SP)(SP)-2，（SP）直接寻址单元中的内容 5436H,；SP指向中的内容 36H(BL),(SP)(SP)+1,；SP指向中的内容 54H

32、(BH),(SP)(SP)+1,xx,xx,36,高地址(栈底),低地址(栈顶）,SP,SP,SP,向下生成,xx,54,CF、AF、PF、ZF、SF、OF,例：,CF0、AF1、PF1、ZF0、SF1、OF CsCp=1（两正数相加结果为负)。,78086/8088 CPU的FLAGS有哪几个状态标志？哪几个控制标志？各标志位的含义和功能是什么？,(1)状态标志：6个CF-进位标志位。PF 奇偶标志位。AF 半进位标志位ZF零标志位。SF符号标志位。OF溢出标志位(2)控制标志：3个TF-单步标志位、跟踪标志。IF 中断允许标志位。DF 方向标志位，用于指定字符串处理命令的步进方向。,【习题

33、与思考】,88086/8088 CPU的存储器组织为什么要采用分段结构？逻辑地址和物理地址的关系是什么？若已知逻辑地址为B100H:A300H，试求物理地址。,逻辑地址：段地址：偏移地址物理地址：也称为绝对地址，由段基址和偏移量两部分构成。物理地址与系统中的存储空间是一一对应的。逻辑地址与物理地址两者之间的关系为：物理地址段地址10H+偏移地址,8若已知当前栈顶的逻辑地址为3000H:200H，试问压入两个字后栈顶的逻辑地址和物理地址是什么?若又弹出3个字后，则栈顶的逻辑地址和物理地址又是什么？9试判断下列运算执行之后，和AF的状态：A323H-8196H,解：压入两个字后栈顶逻辑地址 300

34、0H:1FCH 物理地址:301FCH;若又弹出3个字后，则栈顶的逻辑地址:3000H:202H 物理地址:30202H。,OF=0、CF=0、ZF=0、SF=0、PF=1、AF=1,10若已知一个字串的起始逻辑地址为2000H:1000H，试求该字串中第16个字的逻辑地址及物理地址。11若已知当前栈顶的逻辑地址为3000H:200H，试问压入两个字后栈顶的逻辑地址和物理地址是什么?若又弹出3个字后，则栈顶的逻辑地址和物理地址又是什么？12试判断下列运算执行之后，OF、CF、ZF、SF、PF和AF的状态：(1)A400H+7100H=1500H(2)A323H-8196H(3)46H-59H=0EDH(4)7896H-3528H=436E,OF=0,CF=1,ZF=0,SF=0,PF=1,AF=0,OF=0,CF=1,ZF=0,SF=1,PF=1,AF=1,OF=0,CF=0,ZF=0,SF=0,PF=0,AF=1,mov al,2000hadd al,02,