211时序逻辑电路 (2)汇总ppt课件.ppt
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1、211 时序逻辑电路 (2),目 录,锁存器:输出端的状态不会随输入端的状态变化而变化,只有在有锁存信号时输入的状态才被保存到输出,直到下一个锁存信号。,锁存:把信号暂存以维持某种电平状态。,锁存器描述,74HC373:带三态输出的并入并出八D电平触发锁存器,D7:0输入数据线,Q7:0输出数据线,LE锁存输入信号,八D锁存器74HC373,74HC373电路原理图,八D锁存器74HC373,三态门,D锁存器,八D锁存器74HC373,0/1,LE = 1时,锁存器打开,锁存器的输出随输入变化;,LE = 0时,输入信号被锁存,之后锁存器的输出不随输入变化。,八D锁存器74HC373,八D锁存
2、器74HC373,特性表,输入,内部锁存,输出,Qn,功能描述,LE,Dn,1 高阻 总线隔离,0 0 0 锁存,0,0 1 1 锁存,1 0 0 0 透明传输,1 1 1 1 透明传输,Q,LE,D,高阻,透明传输,锁存,透明传输,锁存,八D锁存器74HC373, 关键知识点,从存储数据的角度来看,74HC373是电平触发电路,如果输入数据的刷新可能出现在控制(使能)信号开始有效之后,则只能使用锁存器,它不能保证输出同时更新状态。在实际的应用中,由于数据与CPU是独立变化的,当外部的数据进入CPU时,势必不能稳定地读入,唯一的办法就是通过“读”信号将数据以锁存状态读入,因此D锁存器常用于向C
3、PU输入数据。,寄存器,寄存器:数字系统中用来存储二进制数据的逻辑部件;寄存器基本组成单元为“触发器”1个触发器可存储1位二进制数据,暂时寄存包裹;每个储物柜只能寄存一个包裹。,寄存器74HC374,集成电路74HC374为8通道上升沿触发锁存器带三态输出的并入并出八D触发器(8位寄存器)。,寄存器74HC374,D7:0输入数据线,Q7:0输出数据线,CP时钟脉冲信号,置1,置0,置1,置1,寄存器74HC374,回顾维持阻塞D触发器的时序图:,74HC374的基本组成是维持阻塞D触发器。,寄存器74HC374,三态门与74HC373相同,CP,D,Q,CP为高或低时,不管输入如何,触发器输
4、出保持原状态不变;CP上升沿到来时,触发器输出变为与输入D该时刻同样的状态。,寄存器74HC374,特性表,输入,内部寄存,输出,Qn,功能描述,CP,Dn,1 高阻 总线隔离, 0 0 寄存,0, 1 1 寄存, 0 0 0 触发, 1 1 1 触发, 关键知识点,当数据来自于CPU内部时,在“写”信号的作用下,将数据读入寄存器,在输出端口输出数据。与此同时,CPU的输出数据与写信号同步地连续不断地刷新寄存器,在输出端输出数据。因此,使用D触发器的寄存器常用于CPU的数据输出。,小结,小结,小结,锁存器实验,1,2,4,连接顺序:,此电路中无:用并行排线将B3实验区“与74HC373输入端D
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