第五章计算机操作系统设备管理课件.ppt
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1、2022/11/29,1,学院: 计算机与信息技术学院教师: 刘贤梅,第五章 设备管理,2022/11/29,2,内容概述,5.1 I/O系统 5.2 I/O控制方式 5.3 缓冲管理,I/O系统包括用于实现数据输入、输出、存储功能的设备和相应的控制器,设备管理的基本任务是完成用户提出的I/O请求,提高I/O速率以及改善I/O的利用率。设备管理的主要功能有缓冲区管理、设备分配、磁盘管理、虚拟设备及实现设备独立性。,5.4 I/O软件 5.5 设备分配 5.6 磁盘存储器管理,2022/11/29,3,5.1 I/O系统,5.1.1 I/O设备5.1.2 设备控制器5.1.3 I/O通道5.1.
2、4 总线系统,2022/11/29,4,5.1.1 I/O设备,1.按设备的使用特性分类存储设备 磁带、磁盘、光盘等。输入/输出设备键盘、鼠标、扫描仪、视频摄像、传感器等。,2022/11/29,5,2.按传输速率分类低速设备 每秒几个字节至数百字节。键盘、鼠标、语音输入输出设备等。中速设备每秒数千至数万字节。行式打印机、激光打印机等。高速设备每秒数百K至数十M字节。磁盘机、磁带机、光盘机等。,2022/11/29,6,3.按信息交换的单位分类块设备信息的存取以数据块为单位,有结构设备。基本特征是其传输速率较高,通常每秒钟为几兆位,可寻址,即对它可随机地读/写任一块。例:磁盘字符设备基本单位是
3、字符,无结构设备。基本特征是其传输速率较低,通常每秒钟为几个字节到数千字节,不可寻址。例:交互式终端、打印机,2022/11/29,7,4.按设备的共享属性分类独占设备(临界资源 )如打印机共享设备 可供多个多个进程同时访问,如磁盘。共享设备必须是可寻址的和可随机访问的设备。虚拟设备通过虚拟技术将一台独占设备变换为若干个逻辑设备,供若干个进程同时使用。,2022/11/29,8,5.1 I/O系统,5.1.1 I/O设备5.1.2 设备控制器5.1.3 I/O通道5.1.4 总线系统,2022/11/29,9,5.1.2 设备控制器,1.设备控制器概述设备控制器是CPU与I/O设备之间的硬件接
4、口,常做成印刷电路卡形式,也称接口卡。 接收从CPU发来的命令,并控制一个或多个I/O设备,以实现I/O设备和计算机之间的数据交换,减轻CPU的负担。,2022/11/29,10,2.设备控制器的组成设备控制器与处理机的接口该接口用于实现设备控制器与CPU之间的通信。在该接口中有三类信号线:数据线、地址线、控制线。设备控制器与设备的接口在一个设备控制器上,可以连接一台或多台设备(一个或多个设备接口),一个接口连接一台设备,在每个接口中都有数据、控制和状态三种类型的信号。 I/O逻辑控制器对设备的控制通过I/O逻辑实现的。包括对收到命令和地址进行译码。,2022/11/29,11,图5-2 设备
5、控制器的组成,2022/11/29,12,5.1 I/O系统,5.1.1 I/O设备5.1.2 设备控制器5.1.3 I/O通道5.1.4 总线系统,2022/11/29,13,5.1.3 I/O通道,1.I/O通道设备的引入是一种特殊处理机,专门负责输入/输出工作,具有执行I/O指令的能力。主要目的是为了建立独立的I/O操作,使有关对I/O操作的组织、管理及其结束处理也独立于CPU。CPU向I/O通道发送I/O命令,由通道执行程序。通道与一般处理机的区别指令类型单一,局限于与I/O操作有关命令。没有独立的内存,通道与CPU共享内存。,2022/11/29,14,图5-3 字节多路通道的工作原
6、理,2.通道类型(1)字节多路通道一个主通道连接多个子通道,以时间片轮转方式共享主通道。每个子通道每次只传送一个字节,连接中低速设备。,2022/11/29,15,(2)数组选择通道(Block Selector Channel)(1)不适合高速设备。以数组方式工作,高速传输数据。可以连接多台高速设备。每次只有一台设备进行数据传送,形成独占,如果它不传数据,别的设备也传不了。通道利用率较低。,2022/11/29,16,(3)数组多路通道(Block Multiplexor Channel)(2)有独占性。将数组选择通道传输速率高和字节多路通道分时并行操作的优点相结合而形成的一种新通道。其数据
7、传送是按数组方式。采用分时并行传送多个非分配型子通道,因而这种通道既具有很高的数据传输速率,又能获得令人满意的通道利用率。,2022/11/29,17,图5-5 多通路I/O系统,2022/11/29,18,5.1 I/O系统,5.1.1 I/O设备5.1.2 设备控制器5.1.3 I/O通道5.1.4 总线系统,2022/11/29,19,5.1.4 总线系统,图5-6 总线型I/O系统结构,在计算机系统中的各部件,如CPU、存储器以及各种I/O设备之间都是通过总线来联系。,2022/11/29,20,1.ISA(Industry Standard Architecture)总线 这是为了1
8、984年推出的80286型微机而设计的总线结构。 其总线的带宽为8位,最高传输速率为2Mb/s。之后不久又推出了16位的(EISA)总线,其最高传输速率为8Mb/s,后又升至16 Mb/s,能连接12台设备。2.EISA(Extended ISA)总线 到80年代末期,ISA总线已难于满足带宽和传输速率的要求,于是人们又开发出扩展ISA(EISA)总线,其带宽为32位,总线的传输速率高达32Mb/s,同样可以连接12台外部设备。,2022/11/29,21,3.VESA(Video Electronic Standard Association)总线 以ISA为基础的局部总线,带宽为32位,工
9、作频率为33MHz,最高传输速率为132Mb/s,为486设计的。4.PCI(Peripheral Component Interface)总线 局部总线,最大传输速率为132Mb/s,既可以连接ISA、EISA等传统型总线,又可支持Pentium的64位系统。,2022/11/29,22,内容概述,5.1 I/O系统 5.2 I/O控制方式 5.3 缓冲管理 5.4 I/O软件5.5 设备分配5.6 磁盘存储器管理,2022/11/29,23,5.2 I/O控制方式,5.2.1 程序I/O方式5.2.2 中断驱动I/O方式5.2.3 直接存储器访问DMA I/O控制方式5.2.4 I/O通道
10、控制方式,设备管理的主要任务之一是控制设备和内存或CPU之间的数据传送。I/O控制方式主要有四种:程序I/O方式、中断驱动I/O方式、直接存储访问DMA I/O控制方式和I/O通道控制方式。,2022/11/29,24,5.2.1 程序I/O方式,程序I/O控制方式(“忙等待”方式):在一个设备的操作没有完成时,控制程序一直检测设备的状态,直到该操作完成,才能进行下一个操作。CPU通过I/O测试指令测试设备接口中的状态位,当为“忙”时则一直测试,当为“闲”时,可进行数据传送,每次传送一个字符。CPU的绝大部分时间都处于等待I/O设备完成数据I/O的循环测试中。外设不能合理使用,也无法支持多道程
11、序。CPU的高速性和I/O设备的低速性。,2022/11/29,25,图5-7 程序I/O方式的流程,2022/11/29,26,5.2 I/O控制方式,5.2.1 程序I/O方式5.2.2 中断驱动I/O方式5.2.3 直接存储器访问DMA I/O控制方式5.2.4 I/O通道控制方式,2022/11/29,27,5.2.2 中断驱动I/O控制方式,中断是指计算机在执行期间,系统内发生任何非寻常的或非预期的急需处理事件,使得CPU暂时中断当前正在执行的程序而转去执行相应的事件处理程序,待处理完毕后又返回原来被中断处继续执行或调度新的进程执行的过程。中断驱动方式:当某进程要启动某个I/O设备工
12、作时,便由CPU向相应的设备控制器发出一条I/O命令,然后立即返回继续执行原来的任务。设备控制器按命令要求去控制指定的I/O设备,完成后,通过中断向CPU发送一中断信号。在I/O设备输入数据的过程中,无须CPU干预。每次传送一个字符。,2022/11/29,28,在I/O中断方式下,数据的输入(或输出)步骤如下:1、要求输入数据的进程把一个启动命令和允许中断位“1”写入相应设备的控制状态寄存器中,从而启动了该设备。2、该进程因等待输入的完成进入睡眠状态。3、当输入完成后,输入设备向CPU发出完成中断请求信号。4、处理机响应中断,处理该中断,并唤醒等待输入完成的进程。5、在以后的某个时期,该程序
13、被调度到后,继续运行。,2022/11/29,29,图5-7 中断驱动方式的流程,2022/11/29,30,5.2 I/O控制方式,5.2.1 程序I/O方式5.2.2 中断驱动I/O方式5.2.3 直接存储器访问DMA I/O控制方式5.2.4 I/O通道控制方式,2022/11/29,31,5.2.3 直接存储器访问DMA I/O控制方式,1.DMA(Direct Memory Access)控制方式的引入,中断驱动I/O控制方式:以字节为单位的。每完成一个字节的I/O,控制器便向CPU发一中断,请求CPU中断处理。例如,为了从磁盘中读出1KB的数据块,需要中断1K次CPU。 直接存储器
14、存取控制:是指对I/O设备的控制由DMA控制器完成,在DMA控制器的作用下,设备和主存之间可以成批地进行数据交换,而不用CPU的干涉。,2022/11/29,32,图5-7 DMA方式的流程,2022/11/29,33,图5-8 DMA控制器的组成,2.DMA控制器的组成主机与DMA控制器的接口DMA控制器与块设备的接口I/O控制逻辑,2022/11/29,34,为了实现在主机与控制器之间成块数据的直接交换, 必须在DMA控制器中设置如下四类寄存器: (1)命令/状态寄存器CR。用于接收从CPU发来的I/O命令或有关控制信息,或设备的状态。 (2)内存地址寄存器MAR。在输入时,它存放把数据从
15、设备传送到内存的起始目标地址;在输出时,它存放由内存到设备的内存源地址。 (3)数据寄存器DR。用于暂存从设备到内存,或从内存到设备的数据。 (4)数据计数器DC。存放本次CPU要读或写的字(节)数。,2022/11/29,35,3.DMA工作过程,图5-9 DMA方式的工作流程,2022/11/29,36,4.直接存储器存取控制方式的步骤当进程要求设备输入一批数据时,CPU将设备存放输入数据的内存始址以及要传送的字节数分别送入DMA控制器中的地址寄存器和传送字节计数器;另外,还要将中断位和启动位置为1,以启动设备开始进行数据输入并允许中断。发出数据要求的进程进入等待状态,进程调度程序调度其他
16、进程占据CPU。输入设备不断地挪用CPU工作周期,将数据寄存器中的数据源源不断地写入内存,直到所要求的字节全部传送完毕。DMA控制器在传送字节数完成时,通过中断请求线发出中断信号,CPU收到中断信号后转中断处理程序,唤醒等待输入完成的进程,并返回被中断的程序。在以后的某个时刻,进程调度程序选中提出请求输入的进程,该进程从指定的内存始址取出数据做进一步处理。,2022/11/29,37,5.2 I/O控制方式,5.2.1 程序I/O方式5.2.2 中断驱动I/O方式5.2.3 直接存储器访问DMA I/O控制方式5.2.4 I/O通道控制方式,2022/11/29,38,5.2.4 I/O通道控
17、制方式,通道控制方式的概念 是一种以内存为中心,是设备与内存直接交换数据的控制方式。CPU只需要发出启动指令,指出通道相应的操作和I/O设备,该指令就可以启动通道并使该通道从内存中调出相应的通道指令执行。,2022/11/29,39,1.I/O通道控制方式的引入 与DMA类似,是以内存为中心的数据交换方式。它可进一步减少CPU的干预,即把对一个数据块的读(写)为单位的干预,减少为对一组数据块的读(写)及有关的控制和管理为单位的干预。一个通道控制多台设备。CPU仅在I/O操作的开始和结束时花费少量时间处理与I/O有关的工作。实现CPU、通道和I/O设备三者的并行操作,从而更有效地提高整个系统的资
18、源利用率。,5.2.4 I/O通道控制方式,2022/11/29,40,2.通道程序 与设备控制器共同实现对I/O设备的控制的。指令中含:(1)操作码:规定指令所执行的操作,如读、写、控制等。(2)内存地址:标明字符送入内存或从内存取出的内存首址。(3)计数:本条指令所要读/写的字节数。(4)通道程序结束位:表示通道程序是否结束,P=1表示结束。(5)记录结束标志:R=0,表示本指令与下一指令处理同一个 记录;R=1表示处理某记录的最后一条指令。,2022/11/29,41,2022/11/29,42,图 通道的工作流程,2022/11/29,43,3.通道控制方式的步骤当进程要求输入数据时,
19、CPU发启动指令指明I/O操作、设备号和对应通道。对应通道接收到CPU发来的启动指令后,把存放在内存中的通道指令程序读出,并执行通道程序,控制设备将数据传送到内存中指定的区域。若数据传输结束,则向CPU发出中断请求。CPU收到中断信号后转中断处理程序,唤醒等待输入完成的进程,并返回被中断的程序。在以后的某个时刻,进程调度程序选中提出请求输入的进程,该进程从指定的内存始址取出数据做进一步处理。,2022/11/29,44,内容概述,5.1 I/O系统 5.2 I/O控制方式 5.3 缓冲管理 5.4 I/O软件5.5 设备分配 5.6 磁盘存储器管理,2022/11/29,45,5.3 缓冲管理
20、,5.3.1 缓冲的引入5.3.2 单缓冲和双缓冲5.3.3 循环缓冲5.3.4 缓冲池(Buffer Pool),2022/11/29,46,5.3.1 缓冲的引入,(1)缓和CPU与I/O设备间速度不匹配的矛盾。 (2)减少对CPU的中断频率,放宽对CPU中断响应时间的限制。 (3)提高CPU和I/O设备之间的并行性。,2022/11/29,47,图5-10 利用缓冲寄存器实现缓冲,2022/11/29,48,5.3 缓冲管理,5.3.1 缓冲的引入5.3.2 单缓冲和双缓冲5.3.3 循环缓冲5.3.4 缓冲池(Buffer Pool),2022/11/29,49,5.3.2 单缓冲和双
21、缓冲,1.单缓冲(Single Buffer),图5-11 单缓冲工作示意图,2022/11/29,50,2.双缓冲(Double Buffer),图5-12 双缓冲工作示意图,2022/11/29,51,图5-13 双机通信时缓冲区的设置,2022/11/29,52,5.3 缓冲管理,5.3.1 缓冲的引入5.3.2 单缓冲和双缓冲5.3.3 循环缓冲5.3.4 缓冲池(Buffer Pool),2022/11/29,53,5.3.3 循环缓冲,循环缓冲的引入: 当输入与输出速度基本匹配时,双缓冲能获得较好效果;当速度相差较大时,可引入多个缓冲,组织成循环缓冲的形式。,2022/11/29,
22、54,5.3 缓冲管理,5.3.1 缓冲的引入5.3.2 单缓冲和双缓冲5.3.3 循环缓冲5.3.4 缓冲池(Buffer Pool),2022/11/29,55,5.3.4 缓冲池(Buffer Pool),1. 缓冲池的组成专用缓冲的利用率不高,因此设置公用缓冲池,其中至少应含有以下三种类型的缓冲区:空(闲)缓冲区;装满输入数据的缓冲区; 装满输出数据的缓冲区。 为了管理上的方便,可将相同类型的缓冲区链成一个队列,于是可形成以下三个队列: (1)空缓冲队列emq (2)输入队列inq (3)输出队列outq,2022/11/29,56,2.缓冲区的工作方式,图5-15 缓冲区的工作方式,
23、2022/11/29,57,内容概述,5.1 I/O系统 5.2 I/O控制方式 5.3 缓冲管理 5.4 I/O软件 5.5 设备分配 5.6 磁盘存储器管理,2022/11/29,58,5.4 I/O软件,5.4.1 I/O软件的设计目标和原则5.4.2 中断处理程序5.4.3 设备驱动程序5.4.4 设备独立性软件5.4.5 用户层的I/O软件,2022/11/29,59,5.4.1 I/O软件的设计目标和原则,I/O系统的层次及功能,图5-16 I/O系统的层次及功能,2022/11/29,60,5.4 I/O软件,5.4.1 I/O软件的设计目标和原则5.4.2 中断处理程序5.4.
24、3 设备驱动程序5.4.4 设备独立性软件5.4.5 用户层的I/O软件,2022/11/29,61,5.4.2 中断处理程序,中断处理程序的处理过程:(1)唤醒被阻塞的驱动进程(2)保护被中断进程的CPU环境(3)转入相应的设备处理程序(4)中断处理(5)恢复被中断进程的现场,2022/11/29,62,图5-17 中断现场保护示意图,2022/11/29,63,图5-18 中断处理流程,2022/11/29,64,5.4.3 设备驱动程序,设备驱动程序又称为设备处理程序,是I/O进程与设备控制器之间的通信程序。1.设备驱动程序功能(1)接收由I/O进程发来的命令和参数, 并将命令中的抽象要
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